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학위논문 상세정보

고속 움직임 추정 알고리즘에 적합한 VLSI 구조 연구

A VLSI architecture for fast motion estimation algorithm


이재헌 (한국과학기술원 전기및전자공학과 국내석사)
Abstract

The block matching algorithm is the most popular motion estimation in coding of image sequence. In this paper, we propose a VLSI architecture for implementing a recently proposed fast block matching algorithm, which is called the MRMCS. The proposed architecture consists of a basic unit based on a s...

주제어

#BMA Motion estimation VLSI architecture Low bit rate 블럭 정합 기법 움직임 추정 MRMCS VLSI 구조 저 전송률;

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저자 이재헌
학위수여기관 한국과학기술원
학위구분 국내석사
학과 전기및전자공학과
지도교수 나종범,Ra, Jong-Beom
발행년도 1998
총페이지 vi, 45 p.
키워드 BMA Motion estimation VLSI architecture Low bit rate 블럭 정합 기법 움직임 추정 MRMCS VLSI 구조 저 전송률
언어 kor
원문 URL http://www.riss.kr/link?id=T10508312&outLink=K
정보원 한국교육학술정보원
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DOI 인용 스타일