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논문 상세정보

Abstract

This paper proposes an implementation of DCT (Discrete Cosine Transform) and IDCT (Inverse DCT) using a fast DCT algorithm with shift and addition operations instead of multiplications Based on the proposed algorithm, a new VLSI architecture for the DCT and the IDCT is proposed. It shows modularity , regularity and capability for multiprocessing. Its performance is also simulated by a simulation software, "Compass". The results of the simulation provide the quality of decompression images, the increase in processing speed, representing the superiority of the proposed architecture.

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참고문헌 (0)

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이 논문을 인용한 문헌 (1)

  1. Jeong Dong-Yun ; Seo Hae-Jun ; Bae Hyeon-Deok ; Cho Tae-Won 2006. "2-D DCT/IDCT Processor Design Reducing Adders in DA Architecture" 電子工學會論文誌. Journal of the Institute of Electronics Engineers of Korea. SD, 반도체, 43(3): 48~58 

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