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논문 상세정보

고정밀 CMOS sample-and-hold 증폭기 설계 기법 및 성능 비교

The design of high-accuracy CMOS sampel-and-hold amplifiers

Abstract

The accuracy of sample-and-hold amplifiers (SHA's) empolying a CMOS process in limited by nonideal factors such as linearity errors of an op amp and feedthrough errors of switches. In this work, after some linearity improvement techniques for an op amp are discussed, three different SHA's for video signal processing are designed, simulated, and compared. The CMOS SHA design techniques with a 12-bit level accuracy are proposed by minimizing cirucit errors based on the simulated results.

참고문헌 (0)

  1. 이 논문의 참고문헌 없음

이 논문을 인용한 문헌 (3)

  1. 1999. "Low-power Analog-to-Digital Converter for video signal processing" 한국통신학회논문지. The journal of Korea Information and Communications Society. 무선통신, 24(a8): 1259~1264 
  2. 1999. "A New Architecture of CMOS Current-Mode Analog-to-Digital Converter Using a 1.5-Bit Bit Cell" 한국음향학회지= The journal of the acoustical society of Korea, 18(2): 53~60 
  3. Cho Seong-Ik 2005. "Pipelined A/D Converter with Multiple S/H Stage Structure" 전기학회논문지. The transactions of the Korean Institute of Electrical Engineers. D / D, 시스템 및 제어부문, 54(3): 186~190 

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