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논문 상세정보

효율적 전류모델을 이용한 고속의 전압 강하와 동적 파워 소모의 분석 기술

Prediction of Dynamic Power Consumption and IR Drop Analysis by efficient current modeling

Abstract

The supply voltage has been drop rapidly and the total length of the wire increased exponentially in the nanometer SoC design environment. The ideal supply voltage was dropped sharply by the resistance and parasitic devices which stayed on the kilometers-long wire length. Even worse, it could severely affect the functional behavior of the block of the design. To analyze the effects of the long wire of the SoC while maintaining the accuracy, the modeling of the current and the RC conversion of the parasitic techniques are researched and applied. By these modeling and conversion, the multi-million gates HDTV Chipset can be analyzed within a day. The benchmark analysis of the HDTV SoC showed the superiority to the conventional methods in performance and accuracy.

저자의 다른 논문

참고문헌 (13)

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이 논문을 인용한 문헌 (1)

  1. Piao, Taiming ; Wee, Jae-Kyung ; Lee, Seongsoo 2013. "A Low EMI Spread Spectrum Clock Generator Using TIE-Limited Frequency Modulation Technique" 전기전자학회논문지 = Journal of IKEEE, 17(4): 537~543 

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