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바디 구동 차동 입력단과 Self-cascode 구조를 이용한 0.5 V 2단 연산증폭기 설계 및 제작
Design and Fabrication of 0.5 V Two Stage Operational Amplifier Using Body-driven Differential Input Stage and Self-cascode Structure 원문보기

전기전자재료학회논문지 = Journal of the Korean institute of electronic material engineers, v.26 no.4, 2013년, pp.278 - 283  

김정민 (충북대학교 반도체공학과) ,  이대환 (충북대학교 반도체공학과) ,  백기주 (충북대학교 반도체공학과) ,  나기열 (충북도립대학 반도체전자전공) ,  김영석 (충북대학교 반도체공학과)

Abstract AI-Helper 아이콘AI-Helper

This paper presents a design and fabrication of 0.5 V two stage operational amplifier. The proposed operational amplifier utilizes body-driven differential input stage and self-cascode current mirror structure. Cadence Virtuoso is used for layout and the layout data is verified by LVS through Mentor...

주제어

AI 본문요약
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문제 정의

  • 본 논문에서는 PMOS의 바디입력을 통한 2단 연산 증폭기 회로를 제안하였다. 기존의 게이트 구동과 다르게 바디 입력을 사용함으로써, 문턱전압제한 효과를 극복하여 공급전압이 0.
  • 본 논문에서는 단일 공급전압 0.5 V에서 동작하는 2단 연산 증폭기를 제안한다. 실험 방법에서 저전압에서 동작할 수 있는 회로 구조와, 제안된 저전압 회로의 최적화 과정을 설명하고, 결과 및 고찰에서 제안된 연산 증폭기의 시뮬레이션 결과와 레이아웃 및 측정 결과를 설명한다.

가설 설정

  • 2. Current mirror (a) cascode structure, (b) self cascode structure.
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질의응답

핵심어 질문 논문에서 추출한 답변
한 개의 태양전지 셀은 동작전압이 몇 V인가? 이런 경우에는 낮은 동작전압 및 적은 전력 소모가 요구된다. 또한 최근 연구가 활발히 이루어지는 태양전지의 경우 한 개 태양 전지 셀의 경우 약 0.5 V 정도이기 때문에 시스템 동작 전압도 여기에 맞출 필요가 있다.
MOSFET이 문턱전압 제한 조건을 피하기 위해 효과적인 해결책 중 하나는 무엇인가? MOSFET을 저전압에서 동작시키기 위해서는 무엇보다도 문턱전압 제한 조건을 피하여야 한다. 이를 위하여 MOSFET의 바디를 이용하는 것이 효과적인 해결책 중의 하나이다 [2].
MOSFET을 저전압에서 동작시키기 위해서 어떻게 해야 하는가? MOSFET을 저전압에서 동작시키기 위해서는 무엇보다도 문턱전압 제한 조건을 피하여야 한다. 이를 위하여 MOSFET의 바디를 이용하는 것이 효과적인 해결책 중의 하나이다 [2].
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참고문헌 (6)

  1. S. Yan and E. Sanchez-Sinencio, IEICE Trans. Analog Integrated Circuits and Systems, E00-A, 1 (2000). 

  2. B. J. Blalock, P. E. Allen, and G. A. Tincon-Mora, IEEE Trans. Circuits Syst. II, 45, 769 (1998). 

  3. B. Razavi, Design of Analog CMOS Integrated Circuits (McGraw-Hill, U.S.A., 2003) p. 35. 

  4. Y. P. Tsividis, Operation and Modelling of the MOS Transistor (McGraw-Hill, U.S.A., 1987) p. 161. 

  5. I. Fujimori and T. Sugimoto, IEEE J. Solid-State Circuits, 33, 1863 (1998). 

  6. L. H. C Ferreira, T. C. Pimenta, and R .L. Moreno, IEEE Trans. Circuits Syst. II, 54, 843 (2007). 

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