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DRAM 소자의 PCT 신뢰성 측정 후 비정상 AlXOY 층 형성에 의해 발생된 불량 연구
A Study of Failure Mechanism through abnormal AlXOY Layer after pressure Cooker Test for DRAM device 원문보기

마이크로전자 및 패키징 학회지 = Journal of the Microelectronics and Packaging Society, v.25 no.3, 2018년, pp.31 - 36  

최득성 (영남이공대학교) ,  정승현 (영남이공대학교) ,  최채형 (영남이공대학교)

초록
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본 연구에서는 DRAM 소자의 Pressure Cooker Test (PCT) 신뢰성 평가 후 발생한 불량 원인에 대한 연구를 진행하였다. 불량 시료의 물리적 관측 결과 변색, Al의 부식 및 손실, 그리고 금속 간 중간 절연막 박리 등이 관측되었다. 추가 물리적 화학적 분석 결과 비정상적인 물질인 $Al_XO_Y$ 층을 발견하였다. 불량 원인을 파악 하기 위해 package ball 크기 실험 및 보호막 pin hole 등의 연관성 실험을 진행하였으나 원인으로 판명되지 않았다. 또한 EMC 물질에 포함되어 있는 Cl에 의한 Al 할로겐화 평가를 진행하였다. 진행 결과 약간의 개선 효과를 보였지만 완벽한 문제 해결을 이루어 내지 못했다. Galvanic corrosion 가능성 가설을 세웠고, 면밀한 분석 결과 pad open 지역에서 Ti 잔존물을 발견할 수 있었다. 검증 실험으로 repair 식각 분리 실험을 진행하여 개선 효과를 보았다. 개선 된 조건에서 PCT 신뢰성 기준치를 만족 하는 결과를 얻었다. 금번 PCT 불량 메카니즘은 다음과 같이 설명할 수 있다. 공정 repair etch시 Ti 잔류물이 남아 Galvanic 메커니즘에 의해 Al이 이온화 된다. 이온화 된 Al이 후속 PCT 신뢰성 측정 시 $H_2O$와 반응하여 비 정상 물질인 $Al_XO_Y$를 생성하였다.

Abstract AI-Helper 아이콘AI-Helper

This research scrutinizes the reason of failure after pressure cooker test (PCT) for DRAM device. We use the physical inspecting tools, such as microscope, SEM and TEM, and finally find the discolor phenomenon, corrosion of Al and delamination of inter-metal dielectric (IMD) in the failed devices af...

주제어

AI 본문요약
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문제 정의

  • 본 연구는 DRAM 공정 기술을 적용하여 완성된 소자를 패키지 후공정까지 진행하여 제조한 완제품에 대한 PCT 신뢰성 평가를 진행하고 평가 기준을 통과하지 못하고 fail 처리된 시료에 대한 원인 파악 연구 결과이다. PCT 처리 후 전기적 측정에 의해 오동작 시료를 판별하였고, 이를 불량 분석 하기 위해 광학 장비를 통해 평면, 단면 촬영하여 불량 양상을 파악 하였다.
  • 본 연구는 반도체 소자의 신뢰성 검사 중 하나인 PCT 검사 후 발생되는 불량에 대한 원인을 파악하고 개선 방법을 제안하는 연구를 수행하였다. PCT 후 발생된 불량시료에 대해 시각적, 물리적 관찰 결과는 변색, Al의 부식 및 손실, 그리고 스트레스에 의한 중간 절연막 융기 등이 발생하였다.
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질의응답

핵심어 질문 논문에서 추출한 답변
신뢰성 평가란 무엇인가? 제조된 반도체 소자는 수명 평가를 위해 신뢰성 평가를 수행하게 되는데, 패키지 공정 전인 전 공정에 대한 신뢰성 평가와 더불어 패키지가 끝난 후 공정에 대한 신뢰성 평가도 매우 중요하고 기술 발전과 더불어보다 정밀하게 측정되고 평가되고 있다. 신뢰성 평가는 초기 불량을 제거하거나 고객이 원하는 동작 시간을 보장해 주어 양질의 제품을 고객에게 제공하기 위한 필수적인 항목이다. 신뢰성 평가의 기본적인 원리는 동작 조건을 가속화 시켜 수명을 측정하는 것이 일반적인 방법이다.
온도가 증가하면 계면들 사이에 어떤 일이 발생하는가? 반도체 소자 집적 공정은 전 공정에 의해 절연막-절연막, 절연막-금속막과 후 공정 금속막-wire bonding ball 등 서로 다른 물질로 구성되어 있는 다양한 계면특성들이 존재 한다. 따라서 온도가 증가하면 계면들 사이에 인장력(tensile force)이나 압축력(compressive force)이 작용하고 이로 인해 박막 격리가 발생하고 심한 경우 파손(crack)이 발생한다.7-11) 또한 파손된 부분에 수분이 침투하여 추가 불량을 발생시킬 수 있는 가능성을 제공해 준다.
PCT(pressure cooker test)와 uHAST는 어떤 방법인가? 패키지까지 완료된 소자의 신뢰성 검사에 많이 사용하는 방법으로는 PCT(pressure cooker test)와 uHAST(unbiased highly accelerated Temperature and humidity stress test)등의 방법이 있다.4-6) 상기 두 가지 신뢰성 측정 방법은 온도와 습도를 정상적 동작 조건보다 가혹하게 설정하여 두 환경에 대한 반도체 소자 열화 특성을 가속화 하여 평가 하는 방법이다. 패키지까지 진행된 소자에 동작 조건보다 상향된 온도와 습도는 금속의 부식, 물리적 스트레스에 의한 접속 부위들의 파손(crack)이나 박막 격리(delamination) 등을 야기 할 수 있다.
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참고문헌 (14)

  1. C. G. Peattie, J. D. Adams and S. L. Carrell, T. D. George, and M. H. Valek, "Elements of semiconductor-device reliability", Proc. IEEE, 62(2), 149 (1974). 

  2. M. G. Pecht, and F. R. Nash, "Predicting the reliability of electronic equipment", Proc. IEEE, 82(7), 992 (1994). 

  3. C. L. Gan, and U. Hashim, "Reliability assessment and mechanical characterization of Cu and Au ball bonds in BGA package", Journal of materials Science:Materials in Electronics, 24(8), 2803 (2013). 

  4. K. Ogawa, J. Suzuki, and K. Sano, "Automatically controlled 2-vesel pressure-cooker test-equipment", IEEE Transactions on reliability, 32(2), 164 (1983). 

  5. J. E. Gunn, S. K. Malik, P. M. Mazumdar, and P. Elmer, "Highly accelerated temperature and humidity stress test technique (HAST)", Proc. 19th International Reliability Physics Symposium, Las Vegas, 48 (1981). 

  6. P. Nemeth, "Accelerated life time test methods for new package technologies", Proc. 24th International Spring Seminar on Electronics Technology, Calimanesti-Caciulata, Romania, 215 (2001). 

  7. C. F. Yu, C. M. Chan, L. C. Chan, and K. C. Hsieh, "Cu wire bond microstructure analysis and failure mechanism", Microelectronics Reliability, 51(1), 119 (2011). 

  8. C. W. Tan, A. R. Daud, and M. A. Yarmo, "Corrosion study at Cu-Al interface in microelectronics packaging", Applied Surface Science, 191(4), 67 (2002). 

  9. W. S. Lee, M. G. Park, and I. W. Cho, "Reliability issues on the high speed DRAM flip-chip package using gold stud bump, lead free solder, and underfill", Electronic Components and Technology Conference, IEEE, 1776 (2008). 

  10. H. Abe, D. C. Kang, T. Yamamoto, T. Yagihashi, and Y. Endo, H. Saito, T. Horie, H. Tamate, Y. Ejiri, N. Watanabe, and T. Iwasaki, "Cu Wire and Pd-Cu Wire Package Reliability and Molding Compounds", Proc. Electronic Components and Technology Conference, IEEE, San Diego, CA, USA, 1117 (2012). 

  11. I. Singh, J. Y. On, and L. Levine, "Enhancing fine pitch, high I/O devices with copper ball bonding", Proc. Electronic Components and Technology Conference, IEEE, 843 (2005). 

  12. T. Uno, and T. Yamada, "Improving humidity bond reliability of copper bonding wires", Proc. Electronic Components and Technology Conference, IEEE, 1725 (2010). 

  13. B. Grosgogreat, L. Reclaru, M. Lissac, and F. Dalard, "Measurement and evaluation of galvanic corrosion between titanium/Ti6Al4V implants and dental alloys by electrochemical techniques and auger spectrometry", Biomaterials, 20(10), 933 (1999). 

  14. T. Rodopoulos, L. Smith, M. D. Horne, and T. Ruther, "Speciation of Aluminium in mixtures of the ionic liquids [ $C_3mpip$ ][ $NTf_2$ ] and [ $C_4mpyr$ ][ $NTf_2$ ] with $AlCl_3$ : an electrochemical and NMR spectroscopy study", Chemistry a European Journal, 16(12), 3815 (2010). 

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