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문제 정의
- 본 논문에서는 2.5G나 3G 아동 단말 장치 등에서 다양한 멀티미디어 응용이 구현 가능하도록 해주는 RISC 프로 세서와 DSP를 단일 칩에서 구현한 듀얼 프로세서 구조에서 비디오 인코딩/디코딩의 처리 속도를 향상시키기 위한 비디오의 인코더/디코더 구조를 제얀하였다. 비디오 신호 처리의 인코딩/디코딩을 구성하는 모듈들을 DSP와 RISC의 특성에 맞도록 두 프로세서에 분리해 수행시킴으로써 효율성을 높이고자 하였다.
- RlSC(Reduced Instruction Set Computer) 프로세서는 다양한 응용을 위해 만들어진 반면 DSP 프로세서는 어떤 특정한 목적을 위해 전용으로 만들어지며 많은 양의 데이터를 소수의 명령어를 사용하여 빠르게 처리하도록 만들어져 있다. 본 논문에서는 RISC 프로세서와 DSP가 단일 칩에 있는 구조에서 비디오 인코딩/디코딩의 처리 속도를 향상시키기 위한 비디오의 인코더/디코더 구조를 제안한다. 기존의 연구에서는 비디오의 인코딩/디코딩의 전 과정을 DSP가 담당하도록 설계하였다[2, 3].
- 위의 연구들은 DSP에서 비디오 신호처리의 모든 인코딩 또는 디코딩의 과정을 DSP가 담당하도록 설계하였으나 많은 비트 연산이 필요한 부분에서는 RISC 칩보다 효율성이 낮게 된다. 본 논문에서는 비디오 신호 처리를 위한 인코더/디코더에서 DSP 프로세서만을 단독으로 사용하지 않고, 두 프로세서를 같이 사용하도록 설계하여 최적의 성능을 발휘할 수 있도록 하였다.
- 5G나 3G 아동 단말 장치 등에서 다양한 멀티미디어 응용이 구현 가능하도록 해주는 RISC 프로 세서와 DSP를 단일 칩에서 구현한 듀얼 프로세서 구조에서 비디오 인코딩/디코딩의 처리 속도를 향상시키기 위한 비디오의 인코더/디코더 구조를 제얀하였다. 비디오 신호 처리의 인코딩/디코딩을 구성하는 모듈들을 DSP와 RISC의 특성에 맞도록 두 프로세서에 분리해 수행시킴으로써 효율성을 높이고자 하였다.
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