[특허]Microprogram controlled digital processor having addressable flip/flop section

Microprogram controlled digital processor having addressable flip/flop section 원문보기

IPC분류정보
국가/구분	United States(US) Patent 등록
국제특허분류(IPC7판)	F41G-007/00 G06F-009/12 G06F-011/04 G06F-015/50
출원번호	US-0570114 (1975-04-21)
발명자 / 주소	Terzian John (Winchester MA)
출원인 / 주소	Raytheon Company (Lexington MA 02)
인용정보	피인용 횟수 : 23 인용 특허 : 0

초록 ▼

A digital processor which is adapted for use in the guidance and stabilization of a guided missile. The digital processor is adapted to store a predetermined macroprogram and to process signals produced by various elements within the missile in accordance with such stored program thereby to produce control signals for the missile\s flight control mechanism. A microinstruction memory stores sets of microinstructions, each one of such sets corresponding to one of a number of stored macroinstructions which make up the macroprogram. A register is provided which is adapted selectively to load an addressed microinstruction or a digital test word serially applied by sources external to the missile. In such an arrangement the missile\s digital processor may be readily checked out through a relatively simple interface mechanism, also included. In the digital processor is a set of addressable flip/flops adapted to be set or reset by signals both internal to and external to the processor. The state of an addressed one of the set of flip/flops serves as a condition signal used in the execution of various ones of the microinstructions. The output of the macroprogram storage memory is adapted to be coupled to the address inputs of the data memory thereby enabling retrieval of both an instruction from the macroprogram memory and its corresponding operand from the data memory within a single clock pulse interval.

대표청구항 ▼

In a digital processor wherein a macroinstruction memory stores a repertoire of macroinstructions, each one of such macroinstructions corresponding to a set of microinstructions; a microinstruction memory stores sets of such microinstructions; a register means stores a digital control word; a source decoder means couples data from one of a plurality of data sources to an input bus selectively in accordance with the stored digital control word; an arithmetic section processes data on such input bus in accordance with the stored digital control word and passes such processed data to an output bus; and a destination decoder means couples processed data on such output bus to one of a plurality of destinations selectively in accordance with the stored digital word, the improvement comprising: a. a first input means connected to the microinstruction memory for coupling a selected one of the microinstructions in parallel form to such register means; b. a second input means for coupling binary signals in serial form from a source external to the processor to the register means; c. control signal means for enabling such register means to store, selectively in accordance with a control signal, as the stored digital word, either the microinstruction coupled by the first input means or the binary signals coupled by the second input means; d. a condition selector means, coupled to the register means and to a plurality of binary signal sources, for coupling one of such binary signal sources onto a condition true line selectively in accordance with the stored digital word; and, including gate means, responsive to the binary signal source on the condition true line, for enabling or inhibiting, selectively in accordance with the binary signal on the condition true line, the processed data on the output bus to pass to the selected one of the destinations; and e. a plurality of flip/flops; a flip/flop selector having a plurality of inputs coupled to the plurality of flip/flops; and, means for coupling a selected one of such flip/flops through the flip/flop selector to enable such selected one of such flip/flops to serve as one of the plurality of binary signal sources.

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