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Actively controlled input buffer

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H03K-019/094
  • H03K-019/017
  • H03K-017/26
  • H03K-017/284
출원번호 US-0313660 (1981-10-22)
발명자 / 주소
  • Wacyk Ihor T. (Bridgewater NJ)
출원인 / 주소
  • RCA Corporation (New York NY 02)
인용정보 피인용 횟수 : 19  인용 특허 : 5

초록

An interface circuit for producing output signals of first and second levels in response to input signals intermediate said first and second levels. The circuit includes a controllable impedance means, normally set to a high impedance condition, connected in series with a first insulated-gate field-

대표청구항

The combination comprising: first and second IGFETs of complementary conductivity type, each IGFET having source and drain electrodes defining the ends of a conduction path and a control electrode; a signal input terminal, a signal output terminal, and first and second power terminals for the applic

이 특허에 인용된 특허 (5)

  1. Suzuki Yasoji (Ayase JPX) Iida Tetsuya (Yokohama JPX), Interface circuit for converting logic signal levels.
  2. Dingwall Andrew Gordon Francis (Somerville NJ) Rosenthal Bruce David (Mountain View CA), Level shift circuit.
  3. Stewart ; Roger Green, Level shift circuit.
  4. Stewart Roger G. (Neshanic Station NJ), Level shift circuit.
  5. Padgett Clarence W. (Westminster CA) Marmet Melvin L. (Corona CA), Metal oxide semiconductor (MOS) input circuit with hysteresis.

이 특허를 인용한 특허 (19)

  1. Slamowitz,Mark, Apparatus for a differential self-biasing CMOS amplifier.
  2. Foss Richard C. (Kanata CAX), CMOS input buffer circuit for TTL signals.
  3. Prater James S. (Fort Collins CO), Driver circuit providing load and time adaptive current.
  4. Stewart Roger G. (Hillsborough Township ; Somerset County NJ), High-speed output driver.
  5. Jeon, Woo-chol; Choi, Jae-bum, Level shifters including circuitry for reducing short circuits and display devices using the same.
  6. Mulatti Jacopo,ITX ; Maccarrone Marco,ITX ; Martines Ignazio,ITX ; Micheloni Rino,ITX, Low-consumption TTL-CMOS input buffer stage.
  7. Moss William E. (Sunnyvale CA), Monostable logic gate in a programmable logic array.
  8. Masleid, Robert Paul, Power efficient multiplexer.
  9. Masleid, Robert Paul, Power efficient multiplexer.
  10. Masleid, Robert Paul, Power efficient multiplexer.
  11. Slamowitz, Mark N.; Radieddine, Bassem, Power-on reset circuit for use in low power supply voltage applications.
  12. Bazes Mel (Haifa ILX), Self-biased, high-gain differential amplifier with feedback.
  13. Wu, Ke, Self-biasing differential buffer with transmission-gate bias generator.
  14. Kim Chang-Hyun (Seoul KRX) Choi Won-Tae (Busan KRX), Semiconductor device having a time delay function.
  15. Bae Myung H. (Songtan KRX), TTL to CMOS input buffer circuit.
  16. Jeong Tae-sung (Seoul KRX), TTL to CMOS input buffer circuit.
  17. Ulmer Richard W. (Austin TX), TTL to CMOS input buffer circuit for minimizing power consumption.
  18. Sharp Patrick O. (Aptos CA), Temperature and process stable MOS input buffer.
  19. Inoue Yoshinori (Hyogo JPX) Kumanoya Masaki (Hyogo JPX) Komatsu Takahiro (Hyogo JPX) Konishi Yasuhiro (Hyogo JPX) Dosaka Katsumi (Hyogo JPX), Voltage boosting circuit and operating method thereof.
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