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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0685125 (1984-12-21) |
우선권정보 | JP-0248204 (1983-12-30) |
발명자 / 주소 |
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출원인 / 주소 |
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인용정보 | 피인용 횟수 : 10 인용 특허 : 4 |
In an arithmetic circuit, a first input of m bits representing the vector expression of a first set of elements of a finite field GF(2m) is converted into the components of a matrix, and each component of the matrix is multiplied by second input of m bits representing the vector expression of a seco
An arithmetic circuit comprising: means for generating as a first input a first set of m bits representing a first vector of a finite field GF(2m) and for generating as a second input a second set of m bits representing a second vector of said finite field; means for converting said first set of m b
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