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Mosfet integrated delay line for digital signals 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H03K-017/28
  • H03K-019/00
출원번호 US-0023211 (1987-03-09)
우선권정보 EP-0103301 (1986-03-12)
발명자 / 주소
  • O\Leary Paul (Gundelfingen DEX)
출원인 / 주소
  • Deutsche ITT Industries GmbH (Freiburg DEX 03)
인용정보 피인용 횟수 : 15  인용 특허 : 7

초록

For continuously adjusting the time delay of this delay line the latter is designed to consist of stages (l, n) which are of the same kind, and contains per stage a conventional CMOS inverter to which, on the P-channel transistor side, a P-channel constant-current transistor and, on the N-channel tr

대표청구항

A MOSFET integrated delay line for digital signals comprising stages of inverters connected in series with respect to the signal flow, characterized in that: each inverter in said stages is a conventional type of CMOS inverter formed by the series connection of the controlled current paths of an N-c

이 특허에 인용된 특허 (7)

  1. Gollinger Wolfgang (Gundelfingen DEX), Cmos inverter.
  2. Young W. Ronald (Palm Bay FL), Current compensation for logic gates.
  3. Southerland ; Jr. Ebbin R. (Houston TX), Dynamic clocking system using six clocks to achieve six delays.
  4. Allgood Robert N. (Austin TX), FET Relaxation oscillator with reduced sensitivity to supply voltage and threshold variations.
  5. Rapp A. Karl (Los Gatos CA), Low power CMOS crystal oscillator.
  6. Gollinger Wolfgang (Gundelfingen DEX) Schat Hermannus (Freiburg DEX) Holzmann Dieter (Freiburg-Munzingen DEX) Elmis Herbert (Denzlingen DEX) Struthoff Holger (Freiburg DEX) Kunz Detlev (Freiburg DEX), MOSFET Integrated delay circuit for digital signals and its use in color-televison receivers.
  7. Mardkha Michael M. (Santa Monica CA), TTL Compatible CMOS input buffer.

이 특허를 인용한 특허 (15)

  1. Alexander Sam E., Apparatus and method for an improved master-slave flip-flop with non-overlapping clocks.
  2. Seefeldt, James; Feng, Xiaoxin; Roper, Weston, Apparatus and method for compensating for process, voltage, and temperature variation of the time delay of a digital delay line.
  3. Gupta, Sandeep Kumar, Apparatus and method for obtaining stable delays for clock signals.
  4. Morikawa, Yoshinao, Correction circuit for generating a control signal for correcting a characteristic change of a transistor, a delay circuit using the same, and a ring oscillator circuit using the same.
  5. Yamazaki, Takema; Ikeda, Masayuki, Delay circuit and electronic device including delay circuit.
  6. Phillips William A. ; Paparo Mario,ITX ; Capocelli Piero,ITX, Delay circuit and method.
  7. Schultz David P. ; Frake Scott O., Delay circuit with temperature and voltage stability.
  8. Sonntag Jeffrey L. (Muhlenberg Twp. ; Berks County PA), Differential controlled delay elements and skew correcting detector for delay-locked loops and the like.
  9. Kwon Oh Bong,KRX, Period controllable frequency generator.
  10. Masleid, Robert Paul, Power efficient multiplexer.
  11. Masleid, Robert Paul, Power efficient multiplexer.
  12. Masleid, Robert Paul, Power efficient multiplexer.
  13. Kim Chang-Hyun (Seoul KRX) Choi Won-Tae (Busan KRX), Semiconductor device having a time delay function.
  14. Hara Takahiko ; Quader Khandker Nazrul ; Watanabe Yohji,JPX, Temperature and power supply adjusted address transition detector.
  15. Iwamoto Hisashi,JPX ; Konishi Yasuhiro,JPX, Voltage control type delay circuit and internal clock generation circuit using the same.
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