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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0023211 (1987-03-09) |
우선권정보 | EP-0103301 (1986-03-12) |
발명자 / 주소 |
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출원인 / 주소 |
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인용정보 | 피인용 횟수 : 15 인용 특허 : 7 |
For continuously adjusting the time delay of this delay line the latter is designed to consist of stages (l, n) which are of the same kind, and contains per stage a conventional CMOS inverter to which, on the P-channel transistor side, a P-channel constant-current transistor and, on the N-channel tr
A MOSFET integrated delay line for digital signals comprising stages of inverters connected in series with respect to the signal flow, characterized in that: each inverter in said stages is a conventional type of CMOS inverter formed by the series connection of the controlled current paths of an N-c
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