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Phase and frequency comparator circuit for phase locked loop 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H03D-013/00
  • H03L-007/087
  • H03L-007/10
출원번호 US-0267549 (1988-11-07)
우선권정보 JP-0282821 (1987-11-09)
발명자 / 주소
  • Kegasa Koyo (Amagasaki JPX)
출원인 / 주소
  • Mitsubishi Denki Kabushiki Kaisha (Hyogo JPX 03)
인용정보 피인용 횟수 : 22  인용 특허 : 3

초록

A phase and frequency detector circuit includes both a phase comparator such as an exclusive-OR gate possessing high phase sensitivity, and a frequency-phase comparator that is sensitive to differences in frequency. The outputs of these circuits are combined to provide a single output signal offerin

대표청구항

A phase and frequency detector circuit, comprising: phase comparator means for receiving a first input signal and a second reference input signal and generating a signal that varies depending on their phase difference; frequency dividing means for frequency-dividing, by the same factor N, said first

이 특허에 인용된 특허 (3)

  1. Nichols Richard A. (Richardson TX), Loop phase detector circuit.
  2. Stryer Arthur N. (Winchester MA), Phase locked loop with compensation for loop phase errors.
  3. Dunn ; David, Phase-locked loops.

이 특허를 인용한 특허 (22)

  1. Kamal Dalmia ; Anil Agarwal IN, Data frequency detector.
  2. Dalmia, Kamal, Digital phase/frequency detector, and clock generator and data recovery PLL containing the same.
  3. Guo Bin (Fremont CA), Digital variable in-lock range phase comparator.
  4. Kennedy, Ian; O'Sullivan, Eugene; Lombaard, Carel J., Fast lock circuit for a phase lock loop.
  5. Ludwig, Lester F., Frequency comparator utilizing enveloping-event detection via symbolic dynamics of fixed or modulated waveforms.
  6. Whiteside Frank A., Jitter attenuator.
  7. Neurauter, Burkhard; Pretl, Harald; Vazny, Rastislav; Greifeneder, Thomas, Loop filter and phase-locked loop.
  8. Xi, Cecilia; Paris, Michael, Methods and devices for determining exercise compliance diagnostics.
  9. Paris, Michael, Methods and devices for determining exercise diagnostic parameters.
  10. Paris,Michael, Methods and devices for determining exercise diagnostic parameters.
  11. Paris,Michael, Methods and devices for determining heart rate recovery.
  12. Xi, Cecilia Qin, Methods and systems for optimizing exercise compliance diagnostic parameters.
  13. Xi, Cecilia Qin, Methods and systems for optimizing exercise compliance diagnostic parameters.
  14. Katayama Satoshi,JPX ; Saito Shinji,JPX ; Kishi Masanori,JPX ; Hasegawa Morihito,JPX, PLL synthesizer having a reset circuit.
  15. Lin,Feng; Baker,R. Jacob, Phase detector for all-digital phase locked and delay locked loops.
  16. Banno Noriyuki,JPX, Phase frequency detecting circuit.
  17. Ludwig, Lester F., Pulse signal waveform asymmetry identification utilizing symbolic dynamics.
  18. Dalmia Kamal, Reference-free clock generation and data recovery PLL.
  19. Dalmia Kamal ; Agarwal Anil,INX, Reference-free clock generator and data recovery PLL.
  20. Hill Martin,AUX, Steered frequency phase locked loop.
  21. Xi, Cecilia Qin; Shaquer, Cem, Systems and methods for improved atrial fibrillation (AF) monitoring.
  22. Chiu,Hon K., Wide frequency range phase-locked loop circuit with phase difference.
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