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Plastic pad array electronic AC device 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-023/48
출원번호 US-0663225 (1991-03-01)
발명자 / 주소
  • Casto James J. (Austin TX) McShane Michael B. (Austin TX) Lin Paul T. (Austin TX)
출원인 / 주소
  • Motorola, Inc. (Schaumburg IL 02)
인용정보 피인용 횟수 : 28  인용 특허 : 0

초록

A pad array electronic device for mounting on a substrate, such as a printed circuit board (PCB), has a relatively rigid package body with a plurality of holes bearing connecting mechanisms for bonding to lands on the PCB. The package body may be a thermoset plastic or other material that can be inj

대표청구항

A method for making a pad array electronic device for mounting on a substrate comprising the steps of: placing an electronic component having a plurality of bonding pads thereon inside a lead frame, where the lead frame has a plurality of leads, each lead having a proximal end and a distal end, the

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  4. Curtin Mark, Board matched nested support fixture.
  5. Huang,Cheng Wei; Yao,Kuang Wei, Chip package.
  6. Oka Takahiro,JPX, Compact resin-sealed semiconductor device.
  7. Kitano Makoto (Tsuchiura JPX) Nishimura Asao (Ushiku JPX) Yaguchi Akihiro (Ibaraki-ken JPX) Yoneda Nae (Ibaraki-ken JPX) Kohno Ryuji (Ibaraki-ken JPX) Tanaka Naotaka (Ibaraki-ken JPX) Kumazawa Tetsuo, Encapsulated semiconductor device package having holes for electrically conductive material.
  8. Pohl, Jens; Muff, Simon; Miersch, Eckehard, Lead frame, circuit board with lead frame, and method for producing the lead frame.
  9. Talledo, Jefferson; Mangaoang, Tito, Leadframe package with side solder ball contact and method of manufacturing.
  10. Talledo, Jefferson; Mangaoang, Tito, Leadframe package with side solder ball contact and method of manufacturing.
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  13. Fjelstad, Joseph C., Method of making a circuit subassembly.
  14. Curtin Mark, Method of making board matched nested support fixture.
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  16. Moliere, Florian; Morand, Sebastien; Douin, Alexandre; Salvaterra, Gerard; Binois, Christian; Peyre, Daniel, Methods and devices for stressing an integrated circuit.
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