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Variable self-correcting digital delay circuit 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H03K-005/13
  • H03K-005/159
출원번호 US-0850215 (1992-03-12)
발명자 / 주소
  • DeLisle Francis A. (Wappingers Falls NY) Jacoutot Alfred M. (Winooski VT)
출원인 / 주소
  • International Business Machines Corporation (Armonk NY 02)
인용정보 피인용 횟수 : 19  인용 특허 : 0

초록

A variable self-correcting on-chip circuit comprised of a plurality of digital circuit components is described, whereby electrical signals are precisely positioned with respect to one another. Electrical signals are converted into a number of pulses within a predefined time window. A first number of

대표청구항

A monolithic integrated variable self-correcting delay circuit having a plurality of components thereon for producing an output signal, the time of occurrence of which is delayed by precise amounts with respect to an input signal applied thereto, wherein a user determines the amount of delay that is

이 특허를 인용한 특허 (19)

  1. Frankeny Richard F. (Elgin TX), Accurately generating precisely skewed clock signals.
  2. Dean Gans ; Eric J. Stave ; Joseph Thomas Pawlowski, Adjustable I/O timing from externally applied voltage.
  3. Nikutta, Wolfgang, Circuit configuration for receiving at least two digital signals.
  4. Frankeny Richard Francis, Clock phase alignment using frequency comparison.
  5. Hiroyuki Hishiyama JP, Delay time regulation method and delay time regulation circuit.
  6. Moore Kendall G. ; Thomasson Samuel L., High resolution delay line.
  7. Owens,Ronnie E.; Rossin,Theodore G.; Metz,Larry S., Method and apparatus for calibrating delay lines.
  8. Choudhury Ashish K., Method and apparatus for generating a time delayed signal with a minimum data dependency error using an oscillator.
  9. Douglas A. Guddat ; Glenn F. King ; Tim Lambert ; Navin Saxena ; Peter J. DesRosier, Method and apparatus for software controlled timing of embedded memory.
  10. Arkin Brian J., Programmable delay circuit having calibratable delays.
  11. Relph Richard, Programmable delay line.
  12. Hui Titkwan (Richardson TX) Mounger Robert W. (Dallas TX), Programmable delay lines.
  13. Fagan, John L.; Bossard, Mark, Selectable delay pulse generator.
  14. Koyanagi, Yoichi; Schober, Jr., Richard L.; Sastry, Raghu; Tamura, Hirotaka, System and method for automatic deskew across a high speed, parallel interconnection.
  15. Koyanagi, Yoichi; Schober, Richard L.; Sastry, Raghu; Tamura, Hirotaka, System and method for automatic deskew across a high speed, parallel interconnection.
  16. Gillette Garry C., System for compensating for temperature induced delay variation in an integrated circuit.
  17. Miura Takeo,JPX, Temperature balanced circuit.
  18. Van Asma Cornelis G. M.,NLX ; Lammers Matheus J. G.,NLX, Timing circuit.
  19. Curran Brian W. (Saugerties NY) Blanco Rafael (Burlington VT), Timing signal generator.
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