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Macro instruction set computer architecture

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • G06F-015/78
출원번호 US-0882295 (1992-05-13)
우선권정보 CN-0103198 (1991-05-17); CN-0103441 (1991-05-21); CN-0103092 (1992-04-27)
발명자 / 주소
  • Liu Dali (Beijing CNX)
출원인 / 주소
  • Duosi Software Co., Ltd. (Beijing CNX 03)
인용정보 피인용 횟수 : 20  인용 특허 : 0

초록

The present invention relates to a macro instruction set computer (MISC) architecture having main memory for storing system softwares of the computer, instructions, and user programs; first memory for storing preparatory data for operations, intermediate results of operations and the final results o

대표청구항

A macro-instruction set computer achictecture comprising: main memory means for storing system softwares of the computer, instructions and user programs; first memory means for storing preparatory data for operation, intermediate results of operation and final results of completed operation, and ope

이 특허를 인용한 특허 (20)

  1. Levanoni, Yosseff; Detlefs, David L.; Gray, Jan S., Accelerating parallel transactions using cache resident transactions.
  2. Levanoni, Yosseff; Sheaffer, Gad; Adl-Tabatabai, Ali-Reza, Accelerating unbounded memory transactions using nested cache resident transactions.
  3. Gray, Jan; Taillefer, Martin; Levanoni, Yosseff; Adl-Tabatabai, Ali-Reza; Detlefs, Dave; Grover, Vinod K.; Magruder, Michael; Sheaffer, Gad, Efficient garbage collection and exception handling in a hardware accelerated transactional memory system.
  4. Gray, Jan; Taillefer, Martin; Levanoni, Yosseff; Adl-Tabatabai, Ali-Reza; Detlefs, Dave; Grover, Vinod K.; Magruder, Michael; Sheaffer, Gad, Efficient garbage collection and exception handling in a hardware accelerated transactional memory system.
  5. Gray, Jan; Taillefer, Martin; Levanoni, Yosseff; Adl-Tabatabai, Ali-Reza; Detlefs, Dave; Magruder, Michael; Callahan, David, Hardware accelerated transactional memory system with open nested transactions.
  6. Taillefer, Martin; Gray, Jan; Wurdack, Richard; Sheaffer, Gad; Adl Tabatabai, Ali-Reza, Instrumentation of hardware assisted transactional memory system.
  7. Sheaffer, Gad; Callahan, David; Gray, Jan; Adl-Tabatabai, Ali-Reza; Raikin, Shlomo, Metaphysically addressed cache metadata.
  8. Charles David K. ; Williams Gerald S., Method for resolving arbitrarily complex expressions at link-time.
  9. Zhang, Jun; Horton, John; Gao, Xinhao Howard, Methods of conferring fire retardancy to wood and fire-retardant wood products.
  10. Adl-Tabatabai, Ali-Reza; Saha, Bratin; Sheaffer, Gad; Bassin, Vadim; Geva, Robert Y.; Taillefer, Martin; Mihocka, Darek; Smith, Burton Jordan; Gray, Jan, Minimizing code duplication in an unbounded transactional memory system by using mode agnostic transactional read and write barriers.
  11. Muthujumaraswathy Kumaraguru ; Rostoker Michael D., Multimedia interface having a multimedia processor and a field programmable gate array.
  12. Muthujumaraswathy, Kumaraguru; Rostoker, Michael D., Multimedia interface having a processor and reconfigurable logic.
  13. Yamada, Koichi; Sheaffer, Gad; Adl-Tabatabai, Ali-Reza; Wang, Landy; Taillefer, Martin; Kishan, Arun; Callahan, David; Gray, Jan; Bassin, Vadim, Operating system virtual memory management for hardware transactional memory.
  14. Yamada, Koichi; Sheaffer, Gad; Adl-Tabatabai, Ali-Reza; Wang, Landy; Taillefer, Martin; Kishan, Arun; Callahan, David; Gray, Jan; Bassin, Vadim, Operating system virtual memory management for hardware transactional memory.
  15. Sheaffer, Gad; Gray, Jan; Taillefer, Martin; Adl-Tabatabai, Ali-Reza; Saha, Bratin; Bassin, Vadim; Geva, Robert Y.; Callahan, David, Performing escape actions in transactions.
  16. Richards Michael J. ; Herdman Douglas J., Phosphate free fire retardant composition.
  17. Richards, Michael J.; Herdman, Douglas J., Phosphate free fire retardant composition.
  18. Gray, Jan; Callahan, David; Smith, Burton Jordan; Sheaffer, Gad; Adl-Tabatabai, Ali-Reza, Private memory regions and coherence optimizations.
  19. Gray, Jan; Callahn, David; Smith, Burton Jordan; Sheaffer, Gad; Adl-Tabatabai, Ali-Reza, Private memory regions and coherency optimization by controlling snoop traffic volume in multi-level cache hierarchy.
  20. Gray, Jan; Callahan, David; Smith, Burton Jordan; Sheaffer, Gad; Adl-Tabatabai, Ali-Reza; Saha, Bratin, Wait loss synchronization.
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