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Advance multilayer molded plastic package using mesic technology 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-021/60
출원번호 US-0140070 (1994-06-14)
국제출원번호 PCT/US93/01481 (1993-02-18)
§371/§102 date 19940614 (19940614)
국제공개번호 WO-9316492 (1993-09-19)
발명자 / 주소
  • Bhattacharyya Bidyut K. (Chandler AZ) Mallik Debendra (Chandler AZ) Ban Syunsuke (Hyogo JPX) Takikawa Takatoshi (Hyogo JPX) Yamanaka Shosaku (Hyogo JPX)
출원인 / 주소
  • Intel Corporation (Santa Clara CA 02)
인용정보 피인용 횟수 : 18  인용 특허 : 0

초록

A method and resulting structure for constructing an IC package utilizing thin film technology. The package has a bottom conductive plate that has a layer of ceramic vapor deposited onto the plate in a predetermined pattern. Adjacent to the insulative layer of ceramic is a layer of conductive metal

대표청구항

A method of constructing an integrated circuit package for an integrated circuit, comprising the steps of: a) providing a conductive plate having at least one tab; b) attaching a first layer of insulative material to said conductive plate; c) attaching a first layer of conductive material to said fi

이 특허를 인용한 특허 (18)

  1. Leonard E. Mess, Ball grid array (BGA) encapsulation mold.
  2. Mess Leonard E., Ball grid array (BGA) encapsulation mold.
  3. Mess Leonard E., Ball grid array (BGA) encapsulation mold.
  4. Mess Leonard E., Ball grid array (BGA) encapsulation mold.
  5. Thomas Stephen J., Chip on board package with top and bottom terminals.
  6. Nathan, Richard J., Embedded carrier for an integrated circuit chip.
  7. Mess, Leonard E., Encapsulation method in a molding machine for an electronic device.
  8. Combs, Edward G.; Sheppard, Robert P.; Pun, Tai Wai; Ng, Hau Wan; Fan, Chun Ho; McLellen, Neil Robert, Enhanced thermal dissipation integrated circuit package.
  9. Pedron, Serafin; McLellan, Neil Robert; Yee, Lin Tsui, Integrated circuit package and method of manufacturing the integrated circuit package.
  10. Bayerer Reinhold,DEX, Method for producing a power semiconductor module.
  11. Sato Hiroaki,JPX ; Ebe Masayoshi,JPX, Method for producing circuit board, for semiconductor package, having cavity for accommodating semiconductor element.
  12. Appelt Bernd Karl ; Kresge John Steven ; Lauffer John Matthew ; Papathomas Kostas I., Method of filling an aperture in a substrate.
  13. Combs,Edward G.; Sheppard,Robert P.; Pun,Tai Wai; Ng,Hau Wang; Fan,Chun Ho; McLellen,Neil Robert, Method of manufacturing an enhanced thermal dissipation integrated circuit package.
  14. McLellan, Neil Robert; Fan, Chun Ho; Combs, Edward G.; Cheung, Tsang Kwok; Keung, Chow Lap; Labeeb, Sadak Thamby, Method of manufacturing an integrated circuit package.
  15. Frederic Beaulieu CA; Mark J. Kuzawinski ; Stephane Mainville CA; Sylvain Ouimet CA; Jean-Guy Quintal CA; Guy Robichaud CA, Method to reduce number of wire-bond loop heights versus the total quantity of power and signal rings.
  16. Leonard E. Mess, Methods for ball grid array (BGA) encapsulation mold.
  17. Ziegner Bernhard Alphonso ; Sletten Robert John ; Jain Nitin ; Brown Steve Robert, Millimeter wave module with an interconnect from an interior cavity.
  18. Kwon Oh-Kyong,KRX, Multilayer lead frame structure that reduces cross-talk and semiconductor package using same and fabrication method thereof.
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