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System for modifying microprocessor operations independently of the execution unit upon detection of preselected opcodes 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • G06F-009/00
출원번호 US-0718180 (1996-09-19)
발명자 / 주소
  • Borkenhagen John Michael
  • Flynn William Thomas
  • Hillier
  • III Philip Rodgers
  • Wottreng Andrew Henry
출원인 / 주소
  • International Business Machines Corporation
대리인 / 주소
    Schmeiser, Olsen & WattsHoffman
인용정보 피인용 횟수 : 22  인용 특허 : 12

초록 ▼

Described herein is a system and method for providing instruction dependent execution control on a microprocessor device. The system and method utilize instruction match register/execution control register (IMR/ECR) pairs to first identify known problematic instructions and to then alter control of

대표청구항 ▼

[ We claim:] [14.] A microprocessor device comprising:instruction matching means for comparing preselected binary opcodes with a plurality of program instructions prior to an execution of each of said program instructions;execution means for executing program instructions; andexecution control means

이 특허에 인용된 특허 (12)

  1. Folwell Dale E. (Placentia CA) Clark Ricke W. (Irvine CA) Harenberg Donald D. (Placentia CA), Branch decision encoding scheme.
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  2. Kihara ; Toshimasa, Instruction altering system.
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  3. Blum ; Arnold ; VON DER Heyden ; Horst ; Irro ; Fritz ; Richter ; Stepha n ; Schaal ; Helmut ; Schulze-Schoelling ; Hermann, Instruction execution modification mechanism for time slice controlled data processors.
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  4. Martin Daniel B. (Poughkeepsie NY), Instruction substitution mechanism in an instruction handling unit of a data processing system.
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  5. Eifert James B. (Austin TX) Vaglica John J. (Austin TX) Smallwood James C. (Austin TX) McDermott Mark W. (Austin TX) Sugiyama Hiroyuki (Tokyo TX JPX) LaViolette William P. (Austin TX) Burgess Bradley, Integrated circuit microprocessor with programmable chip select logic.
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  6. Leach Jerald G. (Houston TX) Simar Laurence R. (Richmond TX), Method and apparatus for processing block instructions in a data processor.
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  7. Sekiguchi Kouji (Kawasaki JPX), Microcontroller with program recomposing function.
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  8. Patrick, Michael J.; Snider, David M., Program patching in microcomputer.
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  9. Hanrahan Donald J. (Endwell NY) Morehead Bruce J. (Endicott NY) Shippy David J. (Endwell NY), Programmable quiesce apparatus for retry, recovery and debug.
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  10. Heene Mark R. (Austin TX) Menkedick Michael H. (Kokomo IN) Sibigtroth James M. (Round Rock TX) Espinor George L. (Austin TX), Single chip microcomputer with patching and configuration controlled by on-board non-volatile memory.
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  11. Miller Gary L. (Austin TX) Goler Vernon B. (Austin TX) Nemirovsky Mario (Goleta CA) DeBrito Daniel N. (Corvallis OR), Timer channel with match recognition features.
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  12. Lai Konrad K. (Aloha OR) Pollack Frederick J. (Portland OR), Type management and control in an object oriented memory protection mechanism.
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이 특허를 인용한 특허 (22)

  1. Mahalingaiah Rupaka ; Miller Paul K., Apparatus and method for microcode patching for generating a next address.
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  2. Mahalingaiah Rupaka ; Tran Thang, Apparatus and method for patching an instruction by providing a substitute instruction or instructions from an external.
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  3. Shin, Young Sam; Lee, Seung Won; Son, Min Young; Lee, Shi Hwa, Apparatus and method for thread progress tracking.
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  4. Cheong Hoichi ; Le Hung Qui, Concurrent execution of machine context synchronization operations and non-interruptible instructions.
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  5. Williams, Michael John; Grisenthwaite, Richard Roy, Diagnosing code using single step execution.
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  6. Williams, Michael John; Grisenthwaite, Richard Roy, Diagnosing code using single step execution.
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  7. Muff, Adam J.; Schardt, Paul E.; Shearer, Robert A.; Tubbs, Matthew R., Instruction predication using instruction filtering.
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  8. Davidson, Joel Roger; Floyd, Michael Stephen; Laurens, Judith E. K.; Mericas, Alexander Erik, Method and apparatus for identifying instructions for performance monitoring in a microprocessor.
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  9. Buzsaki George, Method and apparatus for implementing user-definable error handling processes.
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  10. Davidson, Joel Roger; Derrick, John Edward; Mericas, Alexander Erik, Method and apparatus for instruction sampling for performance monitoring and debug.
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  11. Mintz Michael F., Method and apparatus for optimizing digital processing.
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  12. Floyd, Michael Stephen; Kahle, James Allan; Le, Hung Qui; Moore, John Anthony; Reick, Kevin Franklin; Silha, Edward John, Method and apparatus for patching problematic instructions in a microprocessor using software interrupts.
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  13. Mericas,Alexander Erik, Method and system for counting non-speculative events in a speculative processor.
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  14. Davidson, Joel Roger; Le, Hung Oui; Mericas, Alexander Erik, Method and system for detecting a flush of an instruction without a flush indicator.
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  15. Kevin J. McGrath ; James K. Pickett, Microcode patch device and method for patching microcode using match registers and patch routines.
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  16. Slegel Timothy John ; Check Mark Anthony, Opcode compare logic in E-unit for breaking infinite loops, detecting invalid opcodes and other exception checking.
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  17. Oowaki Yukihito,JPX ; Fujii Hiroshige,JPX ; Sekine Masatoshi,JPX, Processor and information processing apparatus with a reconfigurable circuit.
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  18. Roth,Charles P.; Singh,Ravi P.; Dingh,Tien; Kolagotla,Ravi; Hoffman,Marc; Rivin,Russell, Single-step processing and selecting debugging modes.
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  19. Johnson, David C.; Criswell, Peter B., System and method for expanding the instruction set of an instruction processor.
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  20. Martonosi, Margaret; Brooks, David, System and method of operand value based processor optimization by detecting a condition of pre-determined number of bits and selectively disabling pre-determined bit-fields by clock gating.
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  21. Scherzinger, Bruno; Vollath, Ulrich, Systems and methods for computing vertical position.
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  22. Lloyd,Stacey G., Transaction redirection mechanism for handling late specification changes and design errors.
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