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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0725019 (1996-10-02) |
발명자 / 주소 |
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인용정보 | 피인용 횟수 : 93 인용 특허 : 16 |
A system and method for reducing the time required to access peripheral devices or to perform peripheral device operations in a multiple bus architecture or hierarchical bus structure environment. A memory device is used to remember which addresses generated responses on which busses. The memory dev
[ What is claimed is:] [8.] A method of accessing a device in a hierarchical bus structure comprising a plurality of busses, the method comprising the steps of:first accessing the device by (1) placing an address corresponding to the device on a plurality of busses by traversing through the bus hier
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