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Process for fabricating semiconductor device with shallow p-type regions using dopant compounds containing elements of h 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-021/265
출원번호 US-0514757 (1995-08-14)
발명자 / 주소
  • Ling Peiching
  • Tien Tien
출원인 / 주소
  • Advanced Materials Engineering Research, Inc.
대리인 / 주소
    Lin
인용정보 피인용 횟수 : 13  인용 특허 : 5

초록

A semiconductor having at least one p-channel transistor (10) with shallow p-type doped source/drain regions (16 and 18) which contain boron implanted into the doped regions (16 and 18) in the form of a compound which consists of boron and an element (or elements) selected from the group which consi

대표청구항

[ We claim:] [1.] A method of manufacturing a semiconductor device which includes p-type regions, comprising the steps of:(a) providing a substrate composed of a material represented by a symbol C; and(b) implanting into said substrate an ion compound of a composite dopant represented by a symbol A.

이 특허에 인용된 특허 (5)

  1. Moslehi Mehrdad M. (Los Altos CA), Gas-phase doping method using germanium-containing additive.
  2. Hefner Heinz-Achim (Brackenheim DEX) Imschweiler Joachim (Heilbronn-Bckingen DEX) Seibt Michael (Gttingen DEX), Method for recrystallization of preamorphized semiconductor surfaces zones.
  3. Kodaira Yasunobu (Tokyo JPX), Method of manufacturing bipolar transistor by implanting intrinsic impurities.
  4. Sato Junichi (Tokyo JPX), Method of manufacturing diamond semiconductor.
  5. Keller Charles T. (Tempe AZ) Wu Schyi-Yi (Mesa AZ), Producing a plasma containing beryllium and beryllium fluoride.

이 특허를 인용한 특허 (13)

  1. England, Jonathan Gerald; Hatem, Christopher R.; Scheuer, Jay Thomas; Olson, Joseph C., Ion implantation device with a dual pumping mode and method thereof.
  2. Chaudhry,Samir; Roy,Pradip K., Method and structure for graded gate oxides on vertical and non-planar surfaces.
  3. Brady, David Charles; Ma, Yi; Roy, Pradip Kumar, Method for making an integrated circuit device including a graded, grown, high quality gate oxide layer and a nitride layer.
  4. Kumar Pradip Roy ; Ranbir Singh, Method of making bipolar transistor semiconductor device including graded, grown, high quality oxide layer.
  5. Roy, Kumar Pradip; Singh, Ranbir, Non-volatile memory semiconductor device including a graded, grown, high quality control gate oxide layer and associated methods.
  6. Roy, Kumar Pradip; Singh, Ranbir, Non-volatile memory semiconductor device including a graded, grown, high quality oxide layer and associated methods.
  7. Early, Adrian B., Processes providing high and low threshold p-type and n-type transistors.
  8. Early,Adrian B., Processes providing high and low threshold p-type and n-type transistors.
  9. Kohno, Hiroshi, Semiconductor device and method of fabricating the same.
  10. Judy Xilin An ; Bin Yu, Silicon-on-insulator (SOI) transistor having partial hetero source/drain junctions fabricated with high energy germanium implantation.
  11. An, Judy Xilin; Yu, Bin, Silicon-on-insulator (SOI) transistor having partial hetero source/drain junctions fabricated with high energy germanium implantation..
  12. Chen, Yuanning; Chetlur, Sundar Srinivasan; Roy, Pradip Kumar, TWO-STEP OXIDATION PROCESS FOR OXIDIZING A SILICON SUBSTRATE WHEREIN THE FIRST STEP IS CARRIED OUT AT A TEMPERATURE BELOW THE VISCOELASTIC TEMPERATURE OF SILICON DIOXIDE AND THE SECOND STEP IS CARRIE.
  13. Arevalo, Edwin A.; Hatem, Christopher R.; Renau, Anthony; England, Jonathan Gerald, Techniques for forming shallow junctions.
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