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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0082892 (1998-05-21) |
발명자 / 주소 |
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대리인 / 주소 |
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인용정보 | 피인용 횟수 : 53 인용 특허 : 12 |
The present invention induces provides a gettering trench on the front surface of a device substrate. In one embodiment it induces stress and simultaneously forms a gettering zone 40 for gettering impurities in an integrated circuit structure. In another embodiment, the trench is filled with getteri
[ We claim the following:] [1.] An integrated circuit with a gettering site for gettering impurities comprising:a monocrystalline semiconductor device substrate having a front surface and an upper portion suitable for device formation, the upper portion of said semiconductor device substrate having
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