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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0190905 (1998-11-12) |
발명자 / 주소 |
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출원인 / 주소 |
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대리인 / 주소 |
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인용정보 | 피인용 횟수 : 61 인용 특허 : 13 |
A field programmable memory array having a plurality of sub-arrays is provided. Programmable address decoders, programmable hierarchical bit line arrangements, programmable I/O arrangements, among other features, are provided to enable programming of portions of the array into selected modes. The mo
[ What is claimed is:] [1.] A selective read capture latch for selectively interfacing a hierarchical bit line structure, said selective read capture latch comprising:at least first and second hierarchy inputs for receiving data from respective first and second hierarchy bit lines of the hierarchica
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