최소 단어 이상 선택하여야 합니다.
최대 10 단어까지만 선택 가능합니다.
다음과 같은 기능을 한번의 로그인으로 사용 할 수 있습니다.
NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
---|---|
국제특허분류(IPC7판) |
|
출원번호 | US-0975806 (1997-11-21) |
발명자 / 주소 |
|
출원인 / 주소 |
|
대리인 / 주소 |
|
인용정보 | 피인용 횟수 : 17 인용 특허 : 0 |
In an amplifier stage a first FET receives the input signal at its gate electrode. The drain of the first FET is connected to the drain of a second FET, and both drains are connected to the same drain voltage supply. The amplifier stage output is from the drain of the second FET. A third FET has its
[ I claim:] [1.] An amplifier for amplifying an input signal comprising:a first transistor for receiving the input signal and a second transistor connected to said first transistor to serve as a variable resistance load, andthird and fourth transistors connected in series between an operating voltag
※ AI-Helper는 부적절한 답변을 할 수 있습니다.