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Signal transmission driver circuit, receiver circuit, and method thereof for transmitting and receiving information based on multiple periods and/or a delay function 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H03K-003/00
출원번호 US-0631914 (1996-04-15)
우선권정보 JP-0090681 (1995-04-17)
발명자 / 주소
  • Iwata Toru,JPX
  • Akamatsu Hironori,JPX
  • Kotani Hisakazu,JPX
  • Yamauchi Hiroyuki,JPX
  • Matsuzawa Akira,JPX
  • Tada Shoichiro,JPX
출원인 / 주소
  • Matsushita Electric Industrial Co., Ltd., JPX
대리인 / 주소
    Renner, Otto, Boisselle & Sklar, P.L.L.
인용정보 피인용 횟수 : 24  인용 특허 : 14

초록 ▼

A driver circuit which drives a signal line includes a first output section for outputting a reference voltage potential to the signal line during a first period and a second output section for outputting one of a first information voltage potential and a second information voltage potential in acco

대표청구항 ▼

[ What is claimed is:] [1.] A driver circuit which drives a signal line, comprising:an input for receiving an input signal;a first output section for outputting a reference voltage potential to said signal line during a first period, said outputting of said reference voltage potential being substant

이 특허에 인용된 특허 (14)

  1. Nakayama Yoshio (Menuma JPX) Abe Fuminori (Ooizumi JPX) Nagasawa Naofumi (Ooizumi JPX), Analog switch circuit and signal attenuator employing an analog switch circuit.
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  2. Masuda, Eiji; Matsuo, Kenji; Fujita, Yasuhiko, Autozeroed comparator.
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  3. Smith Edwyn D. (Tucson AZ), Correlated double sampling CCD video preprocessor-amplifier.
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  4. Scott ; III Baker P. L. (Austin TX), Input sampling switch charge conservation.
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  5. Hirasawa Masataka (Yokohama JA) Hashimoto Akira (Yokohama JA), Logical circuit for generating an output having three voltage levels.
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  6. Baginski Mark J. (Boyd Tavern VA) Gasser Ernest S. (Tabb VA) Jessen Dale W. (Charlottesville VA), Method and apparatus for establishing a threshold with the use of a delay line.
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  7. Yuyama Toshio (Kawasaki JPX) Shiraki Ryuzo (Tokyo JPX) Watanabe Seizi (Tokyo JPX), Multi-level signal generating circuit.
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  8. Inoue Yoshitsugu (Hyogo JPX) Uramoto Shinichi (Hyogo JPX) Nakagawa Shinichi (Hyogo JPX), Multiplexer for use in a full adder having different gate delays.
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  9. Evans Thomas E. (Parker CO), Peak detector.
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  10. Goto Kuniaki (Yokosuka JPX), Pulse delay circuit having two comparators.
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  11. Shima Takeshi (Kanagawa JPX), Sample-and-hold circuit device.
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  12. Kannegundla Ram (Rochester NY), Three level high speed clock driver for an image sensor.
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  13. Reinagel Frederick G. (Buffalo NY), Trinary inverter.
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  14. Gleichert Marc C. (San Jose CA) Korn Thomas (San Jose CA), Variable pulse width phase detector.
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이 특허를 인용한 특허 (24)

  1. Kim, Dennis; Zerbe, Jared; Horowitz, Mark; Stonecypher, William, Circuit, apparatus and method for capturing a representation of a waveform from a clock-data recovery (CDR) unit.
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  2. Mori,Masaru, Clock signal detection circuit and semiconductor integrated circuit using the same.
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  3. Roth, Bernhard, Communication circuit for a bi-directional data transmission.
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  4. Masleid, Robert P.; Pitkethly, Scott, Cross point switch.
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  5. Masleid, Robert P.; Pitkethly, Scott, Cross point switch.
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  6. Oh, Hyoung-seok, Flip-flop, frequency divider and RF circuit having the same.
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  7. Atila Alvandpour ; Soumyanath Krishnamurthy ; Ram K. Krishnamurthy, Integrated circuit bus architecture including a full-swing, clocked, common-gate receiver for fast on-chip signal transmission.
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  8. Ho, Andrew; Stojanovic, Vladimir; Garlepp, Bruno W.; Chen, Fred F., Margin test methods and circuits.
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  9. Ho, Andrew; Stojanovic, Vladimir; Garlepp, Bruno W.; Chen, Fred F., Margin test methods and circuits.
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  10. Ho, Andrew; Stojanovic, Vladimir; Garlepp, Bruno W.; Chen, Fred F., Margin test methods and circuits.
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  11. Ho, Andrew; Stojanovic, Vladimir; Garlepp, Bruno W.; Chen, Fred F., Margin test methods and circuits.
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  12. Ho, Andrew; Stojanovic, Vladimir; Garlepp, Bruno W.; Chen, Fred F., Margin test methods and circuits.
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  13. Kim, Young Tae, Memory device and driving circuit adopted by the memory device.
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  14. Zerbe, Jared; Chau, Pak Shing; Stonecypher, William Franklin, Method and apparatus for evaluating and calibrating a signaling system.
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  15. Zerbe, Jared; Chau, Pak Shing; Stonecypher, William Franklin, Method and apparatus for evaluating and optimizing a signaling system.
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  16. Zerbe, Jared; Chau, Pak Shing; Stonecypher, William Franklin, Method and apparatus for evaluating and optimizing a signaling system.
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  17. Zerbe, Jared; Chau, Pak Shing; Stonecypher, William Franklin, Method and apparatus for evaluating and optimizing a signaling system.
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  18. Zerbe, Jared; Chau, Pak Shing; Stonecypher, William Franklin, Method and apparatus for evaluating and optimizing a signaling system.
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  19. Zerbe, Jared; Chau, Pak Shing; Stonecypher, William Franklin, Method and apparatus for evaluating and optimizing a signaling system.
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  20. Zerbe,Jared; Chau,Pak Shing; Stonecypher,William Franklin, Method and apparatus for evaluating and optimizing a signaling system.
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  21. Zerbe,Jared; Chau,Pak Shing; Stonecypher,William Franklin, Method and apparatus for evaluating and optimizing a signaling system.
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  22. Zerbe,Jared; Chau,Pak Shing; Stonecypher,William Franklin, Method and apparatus for evaluating and optimizing a signaling system.
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  23. Dietrich,Stefan; Schr철gmeier,Peter; Kieser,Sabine; Weis,Christian, Method and device for data transfer.
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  24. Garlepp,Bruno W., Statistical margin test methods and circuits.
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