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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0974970 (1997-11-20) |
발명자 / 주소 |
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출원인 / 주소 |
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대리인 / 주소 |
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인용정보 | 피인용 횟수 : 22 인용 특허 : 12 |
A hardware-based system for configuring a CPU and chip set logic of a computer system to allow data transfers on both the rising and falling edges of a bus clock signal. The CPU and chip set logic each include bus communication circuitry for transferring data, a storage unit, and a configuration cir
[ What is claimed is:] [10.] A central processing unit (CPU), comprising:a bus communication circuit having:a first data transfer mode effectuating data transfers on a single transition of a bus clock signal; anda second data transfer mode effectuating data transfers on both transitions of the bus c
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