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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0958436 (1997-10-27) |
발명자 / 주소 |
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출원인 / 주소 |
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대리인 / 주소 |
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인용정보 | 피인용 횟수 : 42 인용 특허 : 32 |
If this fails, the compiler allows logic cells from the unchanged portion of the changed electronic design to shift by a limited amount to other logic elements within the target hardware device. At first, this shifting is fairly constrained in order to preserve as much of the original compilation's
[ What is claimed is:] [1.] In a compiler for fitting electronic designs on target hardware devices, which devices have multiple levels of hierarchical containment together defining placement of logic from the electronic designs onto the target hardware devices, a method of fitting a changed electro
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