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Method for producing a semiconductor device using delamination 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-021/00
  • H01L-021/30
  • H01L-021/46
  • H01L-027/12
  • H01L-031/0392
출원번호 US-0140102 (1998-08-25)
발명자 / 주소
  • Doyle Brian S.
출원인 / 주소
  • Intel Corporation
대리인 / 주소
    Blakely, Sokoloff, Taylor & Zafman, LLP
인용정보 피인용 횟수 : 7  인용 특허 : 10

초록

A process for producing a metal oxide semiconductor (MOS) transistor is provided. At least two trenches are formed at a surface of a first substrate. Oxide is deposited onto the at least two trenches. The at least two trenches each have a surface spaced apart from the surface of the first substrate.

대표청구항

[ What is claimed is:] [1.] A method for producing a MOS transistor, the method comprising:a. forming two trenches at a surface of a first substrate;b. forming a first dielectric layer into said two trenches;c. placing a second substrate onto said surface of said first substrate;d. delaminating a la

이 특허에 인용된 특허 (10)

  1. Shappir Joseph (Jerusalem ILX), Buried interconnect structure for semiconductor devices.
  2. Doyle Brian ; Yu Quat T. ; Yau Leopoldo D., Capping layer in interconnect system and method for bonding the capping layer onto the interconnect system.
  3. Sanchez Julian J. (Mesa AZ), Inverse T-gate semiconductor device with self-aligned punchthrough stops and method of fabrication.
  4. Goesele Ulrich M. ; Tong Q.-Y., Method for the transfer of thin layers of monocrystalline material to a desirable substrate.
  5. Sery George E. (San Francisco CA) Smudski Jan A. (San Jose CA), Method of fabricating a high voltage MOS transistor for flash EEPROM applications having a uni-sided lightly doped grain.
  6. Kubo Masahiko (Chiba-ken JPX), Method of making transistor with oxygen implanted region.
  7. Bruel Michel (Veurey FRX), Process for the production of a relief structure on a semiconductor material support.
  8. Bruel Michel (Veurey FRX), Process for the production of thin semiconductor material films.
  9. Hu Chenming (Alamo CA) Chan Mansun J. (Fremont CA) Wann Hsing-Jen (Albany CA) Ko Ping K. (Richmond CA), Silicon-on-insulator transistors having improved current characteristics and reduced electrostatic discharge susceptibil.
  10. Tsang Chi-Hwa (Aloha OR) Spurgin Kerry L. (Hillsboro OR) Parsons Deborah A. (Portland OR) Hargrove William L. (Sherwood OR) Radhakrishnan Ganesan (Hillsboro OR), Trench isolation with planar topography and method of fabrication.

이 특허를 인용한 특허 (7)

  1. Timothy Daryl Stanley ; Peter Stanley, Method for producing SOI wafers by delamination.
  2. Aspar, Bernard; Lagahe-Blanchard, Chrystelle, Method for producing partial SOI structures comprising zones connecting a superficial layer and a substrate.
  3. Aspar, Bernard; Lagahe-Blanchard, Chrystelle, Method for producing partial SOI structures comprising zones connecting a superficial layer and a substrate.
  4. Krishnan Srinath ; Buynoski Matthew S., Method of creating selectively thin silicon/oxide for making fully and partially depleted SOI on same waffer.
  5. Adachi,Naoshi; Nakamae,Masahiko, Pasted SOI substrate, process for producing the same and semiconductor device.
  6. Wong,William; Shih,Chinwen; Lujan,Rene A.; Chow,Eugene, Selective delamination of thin-films by interface adhesion energy contrasts and thin film transistor devices formed thereby.
  7. Bower,Robert W., Smooth thin film layers produced by low temperature hydrogen ion cut.
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