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Method of changing the power dissipation across an array of transistors 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-021/8234
  • H01L-021/336
  • H01L-029/76
  • H01L-029/94
  • H01L-031/062
출원번호 US-0088027 (1998-06-01)
발명자 / 주소
  • Dupuy Phillipe,FRX
  • Merchant Steven L.
  • Baird Robert W.
출원인 / 주소
  • Motorola, Inc.
대리인 / 주소
    Collopy
인용정보 피인용 횟수 : 12  인용 특허 : 5

초록

A field effect transistor (30) has an array of transistors (31) made up of bonding pads (45-47) and sub-arrays of transistors (41-43). The bonding pads (45-47) are distributed between the sub-arrays of transistors (41-43) to reduce the maximum temperature that any portion of the FET (30) is exposed

대표청구항

[ What is claimed is:] [1.] A method of changing the power dissipation across an array of transistors comprising the step of forming the array of transistors such that transistors in a central portion of the array of transistors has a higher threshold voltage than transistors in an outer portion of

이 특허에 인용된 특허 (5)

  1. Kashiwagi Shunji (Yokohama JPX), High power frequency semiconductor device with improved thermal resistance.
  2. Anderson Floyd E. (15002 S. 40th Pl. Phoenix AZ 85044) Robb Stephen P. (211 W. Greentree Dr. Tempe AZ 85284) Shaw Pern (5209 Raincreek Pkwy. Austin TX 78759) Terry Lewis E. (4812 E. Mitchell Phoenix , Microprocessor having high current drive.
  3. Anderson Floyd E. (Phoenix AZ) Robb Stephen P. (Tempe AZ), Microprocessor layout minimizing temperature and current effects.
  4. Phipps John P. (Phoenix AZ) Robb Stephen P. (Tempe AZ) Sutor Judy L. (Chandler AZ) Terry Lewis E. (Phoenix AZ), Semiconductor device having high energy sustaining capability and a temperature compensated sustaining voltage.
  5. Tsuchiaki Masakatsu, Shallow trench isolation formation with deep trench cap.

이 특허를 인용한 특허 (12)

  1. Peng,Kuo Wei; Shiu,Shian Sung, Electronic apparatus for current source array and layout method thereof.
  2. Young,C. David; Barton,Jeffrey A.; VanLaningham,Steven, Generic transmission parameter configuration.
  3. Mabe, Fred D.; Worden, Ian R.; Nicholas, David C.; Clark, Stephen M.; Anderson, Albert J.; Stevens, James A., Network routing process for regulating traffic through advantaged and disadvantaged nodes.
  4. Zommer,Nathan; Tsukanov,Vladimir, Non-uniform power semiconductor and method for making non-uniform power semiconductor.
  5. Zommer, Nathan; Tsukanov, Vladimir, Non-uniform power semiconductor device.
  6. Bez, Roberto; Camerlenghi, Emilio; Ratti, Stefano, Non-volatile memory cell with floating gate region autoaligned to the isolation and with a high coupling coefficient.
  7. Young,C. David; Stevens,James A., On-demand broadcast protocol.
  8. Khemka, Vishnu; Parthasarathy, Vijay; Zhu, Ronghua; Bose, Amitava, Semiconductor component and method of operating same.
  9. Torii, Katsuyuki; Kanazawa, Masaki, Semiconductor device having plural regions and elements with varying areas depending on the region.
  10. Allen,Scott Thomas; Milligan,James William, Semiconductor devices having thermal spacers.
  11. Zommer, Nathan; Ochi, Sam Seiichiro, Video and content controlled backlight.
  12. Zommer, Nathan; Ochi, Sam Seiichiro, Video and content controlled backlight.
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