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Semiconductor integrated circuit with low-power bus structure and system for composing low-power bus structure 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • G06F-013/00
출원번호 US-0143544 (1998-08-28)
우선권정보 JP0232965 (1997-08-28)
발명자 / 주소
  • Usami Kimiyoshi,JPX
출원인 / 주소
  • Kabushiki Kaisha Toshiba, JPX
대리인 / 주소
    Foley & Lardner
인용정보 피인용 횟수 : 16  인용 특허 : 4

초록

A bus (9) is structured to reduce Dower consumption. The bus (9) is used to transfer data among functional blocks (1, 3, 5, 7) formed on an LSI chip. The bus is divided into subsections (9a, 9b, 9c). A pair of the functional blocks (1, 7) whose frequency of mutual data transfer is high is connected

대표청구항

[ What is claimed is:] [1.] A semiconductor integrated circuit comprising:a bus divided into subsections;functional blocks for transferring data among themselves through the bus;connection circuit for connecting adjacent two of the subsections to each other in response to a control signal that indic

이 특허에 인용된 특허 (4)

  1. Schoellkopf Jean-Pierre (Grenoble FRX) Boyer-Chammard Yann (Boulogne-Billancourt FRX), Bus control device comprising a plurality of isolatable segments.
  2. Alexandru Radu (Cheshire CT), Bus structure for an image processor.
  3. Smith Jeremy C. ; Jamison Stephen G., Circuit for electrostatic discharge (ESD) protection.
  4. Reddy Chitranjan N. (1848 Country Club Dr. Milpitas CA 95035) Medhekar Ajit K. (503 Bliss Ct. San Jose CA 95136), Segmented bus architecture for improving speed in integrated circuit memories.

이 특허를 인용한 특허 (16)

  1. VanGilder, James William; Healey, Christopher M.; Zhang, Xuanhang, Analysis of effect of transient events on temperature in a data center.
  2. Wingard, Drew E.; Tomlinson, Jay S., Communications system and method with multilevel connection identification.
  3. Wingard,Drew Eric; Rosseel,Geert Paul; Tomlinson,Jay S.; Robinson,Lisa A., Communications system and method with multilevel connection identification.
  4. Weber,Wolf Dietrich; Aras,Richard; Robinson,Lisa A.; Rosseel,Geert P.; Tomlinson,Jay S.; Wingard,Drew E., Communications system and method with non-blocking shared interface.
  5. Norman,Richard S., High-performance interconnect arrangement for an array of discrete functional modules.
  6. Iwahashi, Daisuke; Tojima, Masayoshi; Kiyohara, Tokuzo, Integrated circuit manufacturing method and semiconductor integrated circuit.
  7. Wingard,Drew Eric; Meyer,Michael J.; Rosseel,Geert P.; Robinson,Lisa; Tomlinson,Jay, Logic system with configurable interface.
  8. Weber,Wolf Dietrich; Wingard,Drew E., Method and apparatus for configuring an interconnect to implement arbitration.
  9. Childers, Sloan; Moran, Mike; Elderton, John; Medford, Mitch, Method and apparatus for replay of historical data.
  10. Timothy Pontius ; Mark Johnson, Method and arrangement for passing data between a reference chip and an external bus.
  11. Primm,Michael; Fowler,John J.; Faulkner,Gary, Method and system for a set of network appliances which can be connected to provide enhanced collaboration, scalability, and reliability.
  12. Fowler, John J.; Cullen, Gerard L., Method and system for monitoring computer networks and equipment.
  13. Childers, Sloan K.; Elderton, John; Primm, Michael, Methods for displaying physical network topology and environmental status by location, organization, or responsible party.
  14. Childers, Sloan K.; Elderton, John; Primm, Michael, Methods for displaying physical network topology and environmental status by location, organization, or responsible party.
  15. Hur, Hwang; Do, Chang-Ho, Semiconductor memory device with signal aligning circuit.
  16. Weber,Wolf Dietrich; Swarbrick,Ian Andrew; Tomlinson,Jay S., Various methods and apparatuses for arbitration among blocks of functionality.
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