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Semiconductor device and a method of manufacturing the same 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-021/8238
출원번호 US-0151401 (1998-09-11)
우선권정보 JP0248160 (1997-09-12)
발명자 / 주소
  • Nishiyama Akira,JPX
출원인 / 주소
  • Kabushiki Kaisha Toshiba, JPX
대리인 / 주소
    Foley & Lardner
인용정보 피인용 횟수 : 26  인용 특허 : 3

초록

In accordance with one aspect of the present invention, a semiconductor device manufacturing method includes the steps of forming an element isolation region 51 on one main surface of a semiconductor substrate 50, forming a gate electrode 53, forming source and drain electrodes 56, forming an insula

대표청구항

[What is claimed is:] [1.]forming a gate electrode adjacent to a main surface of a semiconductor substrate;forming a source and a drain electrode in the main surface of the semiconductor substrate, the gate electrode disposed between the source electrode and the drain electrode;forming a first nitri

이 특허에 인용된 특허 (3)

  1. Wang Pailu ; Lien Chuen-Der ; Terrill Kyle W., Local interconnect structure and process for six-transistor SRAM cell.
  2. Noguchi Shigeru (Osaka JPX) Ishida Satoshi (Osaka JPX) Iwata Hiroshi (Osaka JPX) Sano Keiichi (Osaka JPX) Nakayama Shoichiro (Osaka JPX), Method of fabricating semiconductor device.
  3. Nishiyama Akira (Kawasaki JPX), Semiconductor device and a method for manufacturing the same.

이 특허를 인용한 특허 (26)

  1. Russell, Steven W.; Lee, Wei William, Dielectric layer liner for an integrated circuit structure.
  2. Armitage, Robert D.; Weber, Eicke R., Hafnium nitride buffer layers for growth of GaN on silicon.
  3. Lin,Mou Shiung; Lee,Jin Yuan, Post passivation method for semiconductor chip or wafer.
  4. Okamoto, Naoya, Semiconductor device and method of manufacturing semiconductor device.
  5. Lin, Mou-Shiung, Top layers of metal for high performance IC's.
  6. Lin, Mou-Shiung, Top layers of metal for high performance IC's.
  7. Lin, Mou-Shiung, Top layers of metal for high performance IC's.
  8. Lin, Mou-Shiung, Top layers of metal for high performance IC's.
  9. Lin, Mou-Shiung, Top layers of metal for high performance IC's.
  10. Lin, Mou-Shiung, Top layers of metal for high performance IC's.
  11. Lin, Mou-Shiung, Top layers of metal for high performance IC's.
  12. Lin, Mou-Shiung; Lee, Jin-Yuan, Top layers of metal for high performance IC's.
  13. Lin, Mou-Shiung; Lee, Jin-Yuan, Top layers of metal for high performance IC's.
  14. Lin,Mou Shiung, Top layers of metal for high performance IC's.
  15. Lin,Mou Shiung, Top layers of metal for high performance IC's.
  16. Lin,Mou Shiung, Top layers of metal for high performance IC's.
  17. Lin,Mou Shiung, Top layers of metal for high performance IC's.
  18. Lin,Mou Shiung, Top layers of metal for high performance IC's.
  19. Lin,Mou Shiung, Top layers of metal for high performance IC's.
  20. Lin,Mou Shiung, Top layers of metal for high performance IC's.
  21. Lin,Mou Shiung, Top layers of metal for high performance IC's.
  22. Lin,Mou Shiung, Top layers of metal for high performance IC's.
  23. Lin,Mou Shiung, Top layers of metal for high performance IC's.
  24. Lin,Mou Shiung, Top layers of metal for high performance IC's.
  25. Lin,Mou Shiung, Top layers of metal for high performance IC's.
  26. Lin, Mou-Shiung; Chou, Chiu-Ming; Chou, Chien-Kang, Top layers of metal for integrated circuits.
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