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Package stack via bottom leaded plastic (BLP) packaging 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • B29C-033/42
  • H01L-021/58
출원번호 US-0336925 (1999-06-21)
발명자 / 주소
  • Tandy Patrick W.
출원인 / 주소
  • Micron Technology, Inc.
대리인 / 주소
    Britt
인용정보 피인용 횟수 : 4  인용 특허 : 29

초록

A packaged semiconductor device has bottom surface leads having portions of the package adjacent the lead edges excised. The outer leads may take the form of inverted-J leads, short stub leads, vertically bent leads-in-grooves, or may be entirely eliminated. Lead connections are on the bottom packag

대표청구항

[ What is claimed is:] [1.]1. A mold assembly for encapsulating a die and leadframe of a semiconductor device in a polymeric package by transfer molding, comprising:a top mold plate having a pressure-resisting top and sides;a generally planar, pressure-resisting bottom mold plate configured to be se

이 특허에 인용된 특허 (29)

  1. Variot Patrick (San Jose CA), Apparatus for encapsulating an integrated circuit package.
  2. Mess Leonard E., Ball grid array (BGA) encapsulation mold.
  3. Kierse Oliver J. (County Clare IEX), EMF shielding of an integrated circuit package.
  4. Russell Ernest J. (Richmond TX) Baudouin Daniel A. (Missouri City TX) Le Duy-Loan T. (Missouri City TX) Wallace James (Sugar Land TX), High density semiconductor package.
  5. Whitehead Graham K. (Ipswich GB2) Taylor Kenneth (East Barnet GB2), Integrated circuit chip carrier.
  6. Heinen Katherine G. (Dallas TX), Integrated circuit device and method to prevent cracking during surface mount.
  7. Chun Heung Sup (Seoul KRX), Integrated double-chip semiconductor package and method for fabricating same.
  8. Hernandez Jorge M. (Mesa AZ) Hyslop Michael S. (Chandler AZ), Internally decoupled integrated circuit package.
  9. Song Chi J. (Daejon KRX), Lead frame and semiconductor package with such lead frame.
  10. Casto James J. (Austin TX), Leadless semiconductor device and method for making the same.
  11. Variot Patrick (San Jose CA), Method for encapsulating an integrated circuit package.
  12. King Jerrold L. (Boise ID) Moden Walter L. (Boise ID) Huang Chender (Boise ID), Method for producing high speed integrated circuits.
  13. Tomita Yoshihiro (Itami JPX) Ueda Naoto (Itami JPX) Nishinaka Yoshirou (Itami JPX) Abe Shunichi (Itami JPX) Ichiyama Hideyuki (Itami JPX), Method of making a lead on chip (LOC) semiconductor device.
  14. Chia Chok J. (Santa Clara CA), Method of molding a pin grid array package.
  15. Chun Heung S. (Seoul KRX), Multi-chip semiconductor package.
  16. Loh Wah K. (Richardson TX), Packaged integrated circuit with encapsulated electronic devices.
  17. Hasegawa Miki (Kyoto JPX), Packaging device and its manufacturing method.
  18. Arikawa Tadashi (Toyama JPX) Tsuchiya Mitsuru (Toyama JPX) Ichida Akira (Toyama JPX) Igarashi Tadashi (Toyama JPX), Plastic-packaged semiconductor device having a heat sink matched with a plastic package.
  19. Hasegawa Miki (Kyoto JPX), Resin-packaged electronic component.
  20. Murakami Gen (Machida JPX) Tsubosaki Kunihiro (Hino JPX) Ichitani Masahiro (Kodaira JPX) Nishi Kunihiko (Kokubunji JPX) Anjoh Ichiro (Koganei JPX) Nishimura Asao (Ushiku JPX) Kitano Makoto (Shimoinay, Semiconductor device.
  21. Kasai Junichi (Kawasaki JPX) Tsuji Kazuto (Kawasaki JPX) Taniguchi Norio (Kawasaki JPX) Mashiko Takashi (Kawasaki JPX) Sakuma Masao (Kawasaki JPX) Saigo Yukio (Satsuma JPX) Yoneda Yoshiyuki (Kawasaki, Semiconductor device and carrier for carrying semiconductor device.
  22. Hara Akitoshi (Suwa JPX), Semiconductor device and its manufacturing method.
  23. Sato Mitsutaka (Kawasaki JPX) Kasai Junichi (Kawasaki JPX), Semiconductor device and method of producing the same.
  24. Waki Masaki (Sagamihara JPX) Kasai Junichi (Kawasaki JPX) Aoki Tsuyoshi (Sagamihara JPX) Honda Toshiyuki (Kawasaki JPX) Sato Hirotaka (Kawasaki JPX), Semiconductor device having a plurality of chips.
  25. Hatakeyama Atsushi (Kawasaki JPX) Baba Fumio (Kawasaki JPX) Kasai Junichi (Kawasaki JPX) Sato Mitsutaka (Kawasaki JPX), Semiconductor device having a plurality of chips having identical circuit arrangement sealed in package.
  26. Honda Tosiyuki (Kawasaki JPX) Haranosono Takao (Satsuma JPX), Semiconductor device having a plurality of semiconductor chips.
  27. Fujisawa Tetsuya,JPX ; Sato Mitsutaka,JPX ; Kasai Junichi,JPX ; Mizukoshi Masataka,JPX ; Otokita Kousuke,JPX ; Yoshimura Hiroshi,JPX ; Hayashida Katsuhiro,JPX ; Takashima Akira,JPX ; Ishiguri Masahik, Semiconductor device having an inner lead extending over a central portion of a semiconductor device sealed in a plasti.
  28. Kawahara Toshimi (Kawasaki JPX) Nakaseko Shinya (Kawasaki JPX) Osawa Mitsunada (Kawasaki JPX) Taniguchi Shinichirou (Kagoshima JPX) Osumi Mayumi (Kawasaki JPX) Ishiguro Hiroyuki (Kawasaki JPX) Katoh , Semiconductor device having resin gate hole through substrate for resin encapsulation.
  29. Park Jong Y. (Bucheon KRX) Choi Jong K. (Incheon KRX), Surface mount semiconductor package.

이 특허를 인용한 특허 (4)

  1. Tandy,Patrick W., Mold assembly for a package stack via bottom-leaded plastic (BLP) packaging.
  2. Tandy, Patrick W., Mold assembly for a package stack via bottom-leaded plastic (blp) packaging.
  3. Meadows,Paul Milton, Stacking circuit elements.
  4. Chiu,Anthony M., Surface mount package with integral electro-static charge dissipating ring using lead frame as ESD device.
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