최소 단어 이상 선택하여야 합니다.
최대 10 단어까지만 선택 가능합니다.
다음과 같은 기능을 한번의 로그인으로 사용 할 수 있습니다.
NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
---|---|
국제특허분류(IPC7판) |
|
출원번호 | US-0482758 (2000-01-13) |
발명자 / 주소 |
|
출원인 / 주소 |
|
대리인 / 주소 |
|
인용정보 | 피인용 횟수 : 2 인용 특허 : 4 |
A crack-preventive substrate for fabricating a solder mask in a device site region includes a substrate, which has a top surface and a bottom surface, and a solder mask layer. The substrate is divided into a device site region and a periphery region. The solder mask layer, disposed on the top surfac
[ What is claimed is:] [10.]10. A process for fabricating a semiconductor package, comprising:providing a substrate which has a top surface and a bottom surface, and the substrate also comprises a device site region and a periphery region wherein a slender slot is formed on the substrate on each sid
※ AI-Helper는 부적절한 답변을 할 수 있습니다.