[특허]Wiring-capacitance improvement aid device aiding in improvement of points having wiring-capacitance attributable error only with layout modification, method thereof, and medium having a program there

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Wiring-capacitance improvement aid device aiding in improvement of points having wiring-capacitance attributable error only with layout modification, method thereof, and medium having a program there 원문보기

IPC분류정보
국가/구분	United States(US) Patent 등록
국제특허분류(IPC7판)	G06F-015/60
출원번호	US-0275083 (1999-03-24)
우선권정보	JP0302744 (1998-10-23)
발명자 / 주소	Itoh Niichi,JPX
출원인 / 주소	Mitsubishi Denki Kabushiki Kaisha, JPX
대리인 / 주소	McDermott, Will & Emery
인용정보	피인용 횟수 : 7 인용 특허 : 3

초록 ▼

A wiring-capacitance improvement aid device aiding in eliminating a capacitance-attributable error of layout data generated by an automatic arrangement and routing tool includes a subject-net extraction portion extracting a subject net with a capacitance-attributable error, a network rip-up portion ripping up a cell netted within a predetermined range with respect to a subject net extracted by the subject-net extraction portion, and a constraint imposition portion imposing a wiring-capacitance constraint on a net connected to a cell ripped up by the network rip-up portion.

대표청구항 ▼

[ What is claimed is:] [1.]1. A wiring-capacitance improvement aid device aiding in eliminating a capacitance-attributable error of layout data generated by an automatic arrangement and routing tool performing arrangement and routing while referring to a wiring-capacitance constraint, comprising:a net extraction portion extracting a subject net with a capacitance-attributable error;a network rip-up portion ripping up a cell netted within a predetermined range with respect to the subject net extracted by said net extraction portion; anda constraint imposition portion imposing a wiring-capacitance constraint on a net connected to the cell ripped up by said network rip-up portion.

이 특허에 인용된 특허 (3)

Kunda Ramachandra P. (Milpitas CA) Bozorgui-Nesbat Saied (Belmont CA) Hao Hong (Sunnyvale CA), Apparatus and method identifying false timing paths in digital circuits.
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Eng Tommy K., Creating optimized physical implementations from high-level descriptions of electronic design using placement based information.
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Dupenloup Guy,FRX, Internal clock handling in synthesis script.
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이 특허를 인용한 특허 (7)

Nishtala, Satyanarayana; Shenoy, Jayarama N.; Chou, Tai-Yu; Freda, Michael C., Method and apparatus for defining signal timing for an integrated circuit device.
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Blinne,Richard; Lakshmanan,Viswanathan; Pranesan,Venugopalan, Method and apparatus for implementing engineering change orders.
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Hoff,Jason K.; Lakshmanan,Viswanathan; Josephides,Michael; Prevedel,Daniel W.; Blinne,Richard D.; Kuppinger,Johathan P., Method of implementing an engineering change order in an integrated circuit design by windows.
상세보기
Irie, Kazuyuki, Method of performing timing-driven layout.
상세보기
Irie, Kazuyuki, Method of performing timing-driven layout.
상세보기
Nguyen,Ly D.; Woodcock,Gregory O.; Kujala,Stony, Multi-axial pivoting combustor liner in gas turbine engine.
상세보기
Tanaka, Genichi, Parasitic element extraction apparatus.
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관련 콘텐츠

특허 원문 보기

KIPRIS 원문보기

IPC 상위 출원인

특허정보
IPC	Description
A	생활필수품
A62	인명구조; 소방(사다리 E06C)
A62B	인명구조용의 기구, 장치 또는 방법(특히 의료용에 사용되는 밸브 A61M 39/00; 특히 물에서 쓰이는 인명구조 장치 또는 방법 B63C 9/00; 잠수장비 B63C 11/00; 특히 항공기에 쓰는 것, 예. 낙하산, 투출좌석 B64D; 특히 광산에서 쓰이는 구조장치 E21F 11/00)
A62B-1/08	.. 윈치 또는 풀리에 제동기구가 있는 것

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내보내기 구분	파일저장 인쇄 메일전송
구성항목	기본정보 상세정보 관리번호, 국가코드, 자료구분, 상태, 출원번호, 출원일자, 공개번호, 공개일자, 등록번호, 등록일자, 발명명칭(한글), 발명명칭(영문), 출원인(한글), 출원인(영문), 출원인코드, 대표IPC 관리번호, 국가코드, 자료구분, 상태, 출원번호, 출원일자, 공개번호, 공개일자, 공고번호, 공고일자, 등록번호, 등록일자, 발명명칭(한글), 발명명칭(영문), 출원인(한글), 출원인(영문), 출원인코드, 대표출원인, 출원인국적, 출원인주소, 발명자, 발명자E, 발명자코드, 발명자주소, 발명자 우편번호, 발명자국적, 대표IPC, IPC코드, 요약, 미국특허분류, 대리인주소, 대리인코드, 대리인(한글), 대리인(영문), 국제공개일자, 국제공개번호, 국제출원일자, 국제출원번호, 우선권, 우선권주장일, 우선권국가, 우선권출원번호, 원출원일자, 원출원번호, 지정국, Citing Patents, Cited Patents
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