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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0644526 (2000-08-21) |
발명자 / 주소 |
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출원인 / 주소 |
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대리인 / 주소 |
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인용정보 | 피인용 횟수 : 22 인용 특허 : 12 |
A phase detector which detects the phase difference between the input clock and an output clock. That phase difference is used to gate a high frequency clock, which is provided to the clock input of an up/down counter. The phase detector also indicates whether the phase difference is positive or neg
1. A digital jitter attenuator circuit comprising:a phase detector having a first input coupled to an input line for receiving an input signal, and a second input coupled to an output line; an up/down counter coupled to said phase detector, said up/down counter being programmed to produce an output
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