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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0598691 (2000-06-21) |
발명자 / 주소 |
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출원인 / 주소 |
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대리인 / 주소 |
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인용정보 | 피인용 횟수 : 63 인용 특허 : 9 |
A new method of forming metal interconnect levels containing damascene interconnects and via plugs in the manufacture of an integrated circuit device has been achieved. The method creates a reversed dual damascene structure. A first dielectric layer is provided overlying a semiconductor substrate. T
1. A method to form metal interconnect levels in the manufacture of an integrated circuit device comprising:depositing a first dielectric layer overlying a semiconductor substrate wherein said semiconductor substrate comprises all layers and devices formed prior to said depositing of said first diel
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