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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0789966 (2001-02-21) |
발명자 / 주소 |
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출원인 / 주소 |
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대리인 / 주소 |
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인용정보 | 피인용 횟수 : 37 인용 특허 : 2 |
A buffer circuit includes a delay circuit which is interposed between a signal source and a following circuit. The delay circuit propagates a signal from an input to an output; the signal has associated desired timing relationships between its rising and falling edges. The delay circuit controls the
1. A buffer circuit for correcting signal path and temperature-related timing errors present in a propagating signal, comprising:a signal path for conveying a test signal to a predetermined downstream node, said test signal having associated desired timing relationships between its rising and fallin
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