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Normalization implementation for a logmap decoder

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H03M-013/00
출원번호 US-0511206 (2000-02-23)
발명자 / 주소
  • Martin Langhammer GB
  • Volker Mauer GB
출원인 / 주소
  • Altera Corporation
대리인 / 주소
    Fish & Neave
인용정보 피인용 횟수 : 12  인용 특허 : 19

초록

A programmable logic device can be programmed to configure its logic elements to approximate the normalization of probability values used in the operation of logMAP decoders, thereby significantly reducing the amount of logic resources required in the normalization procedure without significantly de

대표청구항

1. A programmable logic device comprising:a plurality of regions of programmable logic, each having a plurality of input terminals and at least one output terminal, and each being programmable to selectively perform any of a plurality of logic functions on input signals applied to the input terminal

이 특허에 인용된 특허 (19)

  1. Chennakeshu Sandeep ; Hassan Amer A., Communications system and methods employing selective recursive decording.
  2. Haller Haggai H.,ILX ; Stein Jeremy M.,ILX, Efficient iterative decoding.
  3. Berrou Claude (Le Conquet FRX), Error-correction coding method with at least two systematic convolutional codings in parallel, corresponding iterative d.
  4. Nill Christiane G. (Rome NJ ITX) Sundberg Carl-Erik W. (Chatham NJ), Extended list output and soft symbol output viterbi algorithms.
  5. Hladik Stephen Michael ; Van Stralen Nick Andrew ; Fergus Ross John Anderson, High data rate maximum a posteriori decoder for segmented trellis code words.
  6. Altes Richard A. (La Jolla CA), Maximum a posteriori decoder for digital communications.
  7. Bienz Richard A. (Chandler AZ), Maximum likelihood paths comparison decoder.
  8. Hagenauer Joachim,DEX ; Burkert Frank,DEX ; Werner Martin,DEX, Method and coding means for protected transmission of data on the basis of multi-component coding.
  9. Berrou Claude (le Conquet FRX) Adde Patrick (Brest FRX), Method for a maximum likelihood decoding of a convolutional code with decision weighting, and corresponding decoder.
  10. Pyndiah Ramesh (Plouzane FRX) Glavieux Alain (Plouzane FRX) Berrou Claude (Le Conquet FRX), Method for detecting information bits processed by concatenated block codes.
  11. Hagenauer Joachim (Seefeld DEX) Hher Peter (Seefeld DEX), Method for generalizing the viterbi algorithm and devices for executing the method.
  12. Gelblum Ehud Alexander ; Sadjadpour Hamid R., Multi-channel parallel/serial concatenated convolutional codes and trellis coded modulation encoder/decoder.
  13. Hladik Stephen Michael ; Anderson John Bailey, Optimal soft-output decoder for tail-biting trellis codes.
  14. Hladik Stephen Michael ; Anderson John Bailey, Parallel concatenated tail-biting convolutional code and decoder therefor.
  15. Cliff Richard G. (Milpitas CA) Reddy Srinivas T. (Santa Clara CA) Raman Rina (Fremont CA) Cope L. Todd (San Jose CA) Huang Joseph (San Jose CA) Pedersen Bruce B. (San Jose CA), Programmable logic array integrated circuit devices.
  16. Hladik Stephen Michael ; Check William Alan ; Glinsman Brian James ; Fleming ; III Robert Fleming, Satellite communications system utilizing parallel concatenated coding.
  17. Chen Weizhong, Signal quality detector and methods thereof.
  18. Viterbi Andrew J. ; Sindhushayana Nagabhushana T., Soft decision output decoder for decoding convolutionally encoded codewords.
  19. Hladik Stephen Michael ; Ross John Anderson Fergus ; Van Stralen Nick Andrew, Turbo code decoder with modified systematic symbol transition probabilities.

이 특허를 인용한 특허 (12)

  1. Li,Victor On Kwok; Hu,Jianhao; Wong,Alfred K. K., Embedded state metric storage for MAP decoder of turbo codes.
  2. Lee, Inkyu, Generating log-likelihood values in a maximum a posteriori processor.
  3. Bickerstaff,Mark Andrew; Davis,Linda Mary, Higher radix Log MAP processor.
  4. Wang, Duanyi; Kobayashi, Hisashi; Bao, Jay, MAP decoding for turbo codes by parallel matrix processing.
  5. Mar, William, Method and device for correcting signal.
  6. Massey,Peter C., Method of decoding utilizing a recursive table-lookup decoding method.
  7. Langhammer,Martin, Multi-functional digital signal processing circuitry.
  8. Jin, Gary Q., Parallel turbo trellis-coded modulation.
  9. Nicol,Christopher J.; Bickerstaff,Mark Andrew; Xu,Bing; Yan,Ran Hong, Reconfigurable architecture for decoding telecommunications signals.
  10. Jin,Gary Q., Soft-decision decoding of convolutionally encoded codeword.
  11. Mogre,Advait M.; Rhee,Dojun, System to efficiently transmit two HDTV channels over satellite using turbo coded 8PSK modulation for DSS compliant receivers.
  12. Van Stralen,Nick Andrew; Hladik,Stephen Michael; Itani,Abdallah Mahmoud; Wodnicki,Robert Gideon; Ross,John Anderson Fergus, Turbo decoder control for use with a programmable interleaver, variable block length, and multiple code rates.
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