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Process-tolerant integrated circuit design 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • G05F-003/02
출원번호 US-0264070 (1999-03-08)
발명자 / 주소
  • Masakazu Shoji
출원인 / 주소
  • Agere Systems Inc.
대리인 / 주소
    Ryan, Mason & Lewis, LLP
인용정보 피인용 횟수 : 32  인용 특허 : 3

초록

An operating parameter of an integrated circuit is made substantially insensitive to process variations by configuring the circuit such that an environmental parameter, e.g., supply voltage to a portion of the circuit, is made a function of one or more process parameters, e.g., conduction threshold

대표청구항

1. A method of manufacturing a circuit, wherein an operating parameter of the circuit varies as a function f1 of at least one process parameter and at least one environmental parameter, the method comprising the step of:configuring the circuit such that the environmental parameter is a function f2 o

이 특허에 인용된 특허 (3)

  1. Wang Paul P. S. ; Yoshida Alan M. ; Peeters David A., Integrated circuit design for single ended receiver margin tracking.
  2. Leehan Gerald William (Centreville VA), LSI chip compensator for process parameter variations.
  3. Balusek Rudolph D. (Garland TX), Self-regulating oscillator circuit and method.

이 특허를 인용한 특허 (32)

  1. Ferren, Bran; Hillis, W. Daniel; Mangione Smith, William Henry; Myhrvold, Nathan P.; Tegreene, Clarence T.; Wood, Jr., Lowell L., Adjusting a processor operating parameter based on a performance criterion.
  2. Ferren, Bran; Hillis, W. Daniel; Mangione-Smith, William Henry; Myhrvold, Nathan P.; Tegreene, Clarence T.; Wood, Jr., Lowell L., Alteration of execution of a program in response to an execution-optimization information.
  3. Ferren, Bran; Hillis, W. Daniel; Mangione-Smith, William Henry; Myhrvold, Nathan P.; Tegreene, Clarence T.; Wood, Jr., Lowell L., Cross-architecture execution optimization.
  4. Ferren, Bran; Hillis, W. Daniel; Mangione-Smith, William Henry; Myhrvold, Nathan P.; Tegreene, Clarence T.; Wood, Jr., Lowell L., Cross-architecture optimization.
  5. Ferren, Bran; Hillis, W. Daniel; Myhrvold, Nathan P.; Tegreene, Clarence T.; Wood, Jr., Lowell L., Execution optimization using a processor resource management policy saved in an association with an instruction group.
  6. Akahane, Masashi, Gate drive circuit providing constant driving current.
  7. Ferren, Bran; Hillis, W. Daniel; Mangione-Smith, William Henry; Myhrvold, Nathan P.; Tegreene, Clarence T.; Wood, Jr., Lowell L., Handling processor computational errors.
  8. Ferren, Bran; Hillis, W. Daniel; Mangione-Smith, William Henry; Myhrvold, Nathan P.; Tegreene, Clarence T; Wood, Jr., Lowell L., Hardware-error tolerant computing.
  9. Ferren, Bran; Hillis, W. Daniel; Myhrvold, Nathan P.; Tegreene, Clarence T.; Wood, Jr., Lowell L., Instruction-associated processor resource optimization.
  10. Sugiura, Masakazu, Internal power supply voltage generation circuit.
  11. Van Phan,Nghia; Rosno,Patrick Lee; Strom,James David, Method and reference circuit for bias current switching for implementing an integrated temperature sensor.
  12. Truong, Phat; Nguyen, Jon, Method to reduce variation in CMOS delay.
  13. Mangione-Smith, William Henry, Multi-votage synchronous systems.
  14. Ferren, Bran; Hillis, W. Daniel; Myhrvold, Nathan P.; Tegreene, Clarence T.; Wood, Jr., Lowell L., Multiprocessor resource optimization.
  15. Ferren, Bran; Hillis, W. Daniel; Myhrvold, Nathan P.; Tegreene, Clarence T.; Wood, Jr., Lowell L., Multiprocessor resource optimization.
  16. Ramaraju, Ravindraraj; Burch, Kenneth R.; Seaberg, Charles E., Multistage voltage regulator circuit.
  17. Franch, Robert L.; Jenkins, Keith A., On chip temperature measuring and monitoring circuit and method.
  18. Franch,Robert L.; Jenkins,Keith A., On chip temperature measuring and monitoring circuit and method.
  19. Franch,Robert L.; Jenkins,Keith A., On chip temperature measuring and monitoring circuit and method.
  20. Franch, Robert L.; Jenkins, Keith A., On chip temperature measuring and monitoring method.
  21. Franch, Robert L.; Jenkins, Keith A., On chip temperature measuring and monitoring method.
  22. Ferren, Bran; Hillis, W. Daniel; Myhrvold, Nathan P.; Tegreene, Clarence T.; Wood, Jr., Lowell L., Optimization of a hardware resource shared by a multiprocessor.
  23. Ferren, Bran; Hillis, W. Daniel; Myhrvold, Nathan P.; Tegreene, Clarence T.; Wood, Jr., Lowell L., Optimization of instruction group execution through hardware resource management policies.
  24. Mangione-Smith, William Henry, Power sparing synchronous apparatus.
  25. Mangione-Smith, William Henry, Power sparing synchronous apparatus.
  26. Ferren, Bran; Hillis, W. Daniel; Mangione-Smith, William Henry; Myhrvold, Nathan P.; Tegreene, Clarence T.; Wood, Jr., Lowell L., Predictive processor resource management.
  27. Rajagopal, Narasimhan Trichy; Siniscalchi, Patrick Peter, Process, supply, and temperature insensitive integrated time reference circuit.
  28. Roine, Per Torstein; Griffith, Danielle L; Smith, Ryan A, RC oscillator with additional inverter in series with capacitor.
  29. Ferren, Bran; Hillis, W. Daniel; Myhrvold, Nathan P.; Tegreene, Clarence T.; Wood, Jr., Lowell L., Selecting a resource management policy for a resource available to a processor.
  30. Lalithambika, Vinod A.; Garner, David M., Signal generator.
  31. Zhuo, Wei; Khatri, Himanshu; Choksi, Ojas M, Threshold tracking bias voltage for mixers.
  32. Mano, Ryuji; Notani, Hiromi, Voltage controlled oscillation circuit.
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