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Ferroelectric device with capping layer and method of making same 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-027/108
  • H01L-029/76
  • H01L-029/94
  • H01L-031/119
출원번호 US-0229883 (1999-01-14)
발명자 / 주소
  • Hayashi, Shinichiro
  • Otsuki, Tatsuo
  • Paz de Araujo, Carlos A.
출원인 / 주소
  • Symetrix Corporation, Matsushita Electric Industrial Co., Ltd.
대리인 / 주소
    Patton Boggs LLP
인용정보 피인용 횟수 : 1  인용 특허 : 14

초록

A ferroelectric device includes a ferroelectric layer and an electrode. The ferroelectric material is made of a perovskite or a layered superlattice material. A superlattice generator metal oxide is deposited as a capping layer between said ferroelectric layer and said electrode to improve the resid

대표청구항

1. In a ferroelectric device including a substrate supporting a thin film ferroelectric self-ordering layered superlattice material and a top electrode, the improvement comprising a capping layer ranging from 3 nm to 30 nm in thickness interposed between said thin film ferroelectric self-ordering la

이 특허에 인용된 특허 (14)

  1. Tsu Robert (Plano TX) Kulwicki Bernard M. (North Attleboro MA), Barium strontium titanate (BST) thin films by holmium donor doping.
  2. Summerfelt Scott R. ; Beratan Howard Roy, Electrode interface for high-dielectric-constant materials.
  3. Paz de Araujo Carlos A. (Colorado Springs CO) Cuchiaro Joseph D. (Colorado Springs CO) Scott Michael C. (Colorado Springs CO) McMillan Larry D. (Colorado Springs CO), Ferroelectric dielectric memory cell can switch at least giga cycles and has low fatigue - has high dielectric constant.
  4. Kim, Byung-hee; Park, Hong-bae, Ferroelectric random access memory device and fabrication method therefor.
  5. Ooms William J. ; Marshall Daniel S. ; Hallmark Jerald A., Ferroelectric semiconductor device having a layered ferroelectric structure.
  6. Satoh Sakiko (Chiba-ken JPX) Matsunaga Hironori (Chiba-ken JPX) Nakanishi Kenji (Chiba-ken JPX) Masuda Yoshiyuki (Chiba-ken JPX) Koba Masayoshi (Nara-ken JPX), Ferroelectric thin film with intermediate buffer layer.
  7. Ramer O. Glenn ; Rosser Robin W., In situ reactive layers for protection of ferroelectric integrated circuits.
  8. Azuma Masamichi ; Paz De Araujo Carlos A. ; McMillan Larry D., Integrated circuits having mixed layered superlattice materials and precursor solutions for use in a process of making t.
  9. Cuchiaro Joseph D. ; Solayappan Narayan ; Paz de Araujo Carlos A. ; McMillan Larry D., Low imprint ferroelectric material for long retention memory and method of making the same.
  10. Ooms William J. ; Marshall Daniel S. ; Hallmark Jerald A., Method for making a ferroelectric semiconductor device and a layered structure.
  11. Perino Stanley (Colorado Springs CO) Davenport Thomas E. (Colorado Springs CO), Method of manufacturing ferroelectric bismuth layered oxides.
  12. Perino Stanley (Colorado Springs CO) Davenport Thomas E. (Colorado Springs CO), Method of manufacturing ferroelectric bismuth layered oxides.
  13. Watanabe Hitoshi (Tokyo CO JPX) Paz De Araujo Carlos A. (Colorado Springs CO) Yoshimori Hiroyuki (Kanagawa CO JPX) Scott Michael C. (Colorado Springs CO) Mihara Takashi (Saitama CO JPX) Cuchiaro Jose, Process for fabricating layered superlattice materials and making electronic devices including same.
  14. Haushalter Robert C., Reduced fatigue ferroelectric element.

이 특허를 인용한 특허 (1)

  1. Lee, Seok-Won, Capacitor of semiconductor device and fabrication method thereof.
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