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Complement reset latch 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H03K-003/037
출원번호 US-0170948 (2002-06-12)
발명자 / 주소
  • Masleid, Robert P.
  • Giacomotto, Christophe
출원인 / 주소
  • Fujitsu Limited
대리인 / 주소
    Fenwick & West LLP
인용정보 피인용 횟수 : 49  인용 특허 : 4

초록

A complement reset latch is integrated into a complement reset buffer. The complement reset latch is formed by inserting a state element between the input and the output of the complement reset buffer. The state element is used to hold the output stage at a stored value responsive to a clock signal.

대표청구항 ▼

A complement reset latch is integrated into a complement reset buffer. The complement reset latch is formed by inserting a state element between the input and the output of the complement reset buffer. The state element is used to hold the output stage at a stored value responsive to a clock signal.

이 특허에 인용된 특허 (4)

  1. Lee Seung-keun (Seoul KRX) Kwak Choong-keun (Seoul KRX) Kim Chang-rae (Seoul KRX), Data buffer circuit with delay circuit to increase the length of a switching transition period during data signal invers.
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  2. Mehta Anup S. ; Amir Chaim ; Klass Edgardo F. ; Das Ashutosh K., Edge-triggered dual-rail dynamic flip-flop with an enhanced self-shut-off mechanism.
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  3. Pelella Antonio R. (Highland Falls NY), Fast edge triggered self-resetting CMOS receiver with parallel L1/L2 (master/slave) latch.
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  4. Amir Chaim ; Ngo Heip P., Self-reset flip-flop with self shut-off mechanism.
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이 특허를 인용한 특허 (49)

  1. Pitkethly, Scott; Masleid, Robert Paul, Advanced repeater utilizing signal distribution delay.
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  2. Pitkethly,Scott; Masleid,Robert Paul, Advanced repeater utilizing signal distribution delay.
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  3. Pitkethly, Scott, Advanced repeater with duty cycle adjustment.
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  4. Pitkethly, Scott, Advanced repeater with duty cycle adjustment.
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  5. Pitkethly, Scott, Advanced repeater with duty cycle adjustment.
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  6. Pitkethly,Scott, Advanced repeater with duty cycle adjustment.
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  7. Masleid, Robert Paul; Dholabhai, Vatsal, Circuit with enhanced mode and normal mode.
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  8. Masleid, Robert Paul; Kowalczyk, Andre, Circuits and methods for detecting and assisting wire transitions.
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  9. Masleid,Robert Paul; Kowalczyk,Andre, Circuits and methods for detecting and assisting wire transitions.
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  10. Masleid,Robert Paul; Kowalczyk,Andre, Circuits and methods for detecting and assisting wire transitions.
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  11. Masleid, Robert, Circuits, systems and methods relating to a dynamic dual domino ring oscillator.
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  12. Masleid,Robert P., Circuits, systems and methods relating to dynamic ring oscillators.
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  13. Masleid, Robert Paul, Column select multiplexer circuit for a domino random access memory array.
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  14. Masleid, Robert Paul, Configurable delay chain with stacked inverter delay elements.
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  15. Masleid,Robert Paul, Configurable delay chain with stacked inverter delay elements.
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  16. Masleid, Robert Paul, Configurable delay chain with switching control for tail delay elements.
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  17. Masleid, Robert Paul, Configurable tapered delay chain with multiple sizes of delay elements.
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  18. Masleid, Robert P., Converting dynamic repeaters to conventional repeaters.
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  19. Masleid, Robert P.; Pitkethly, Scott, Cross point switch.
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  20. Masleid, Robert P.; Pitkethly, Scott, Cross point switch.
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  21. Masleid, Robert P.; Pitkethly, Scott, Cross point switch.
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  22. Masleid, Robert P, Dynamic ring oscillators.
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  23. Masleid,Robert Paul, Elastic pipeline latch with a safe mode.
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  24. Masleid, Robert P, Inverting zipper repeater circuit.
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  25. Masleid, Robert P., Inverting zipper repeater circuit.
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  26. Masleid, Robert Paul, Inverting zipper repeater circuit.
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  27. Masleid,Robert P., Inverting zipper repeater circuit.
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  28. Masleid, Robert, Leakage efficient anti-glitch filter.
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  29. Masleid,Robert Paul, Leakage efficient anti-glitch filter with variable delay stages.
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  30. Rozas, Guillermo J.; Masleid, Robert P., Method and system for elastic signal pipelining.
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  31. Masleid, Robert Paul, Power efficient multiplexer.
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  32. Masleid, Robert Paul, Power efficient multiplexer.
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  33. Masleid, Robert Paul, Power efficient multiplexer.
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  34. Masleid, Robert Paul, Power efficient multiplexer.
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  35. Masleid,Robert Paul, Power efficient multiplexer.
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  36. Masleid, Robert Paul; Dholabhai, Vatsal; Klingner, Christian, Repeater circuit having different operating and reset voltage ranges, and methods thereof.
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  37. Masleid,Robert Paul; Dholabhai,Vatsal; Klingner,Christian, Repeater circuit having different operating and reset voltage ranges, and methods thereof.
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  38. Masleid,Robert Paul; Dholabhai,Vatsal; Stoiber,Steven Thomas; Singh,Gurmeet, Repeater circuit with high performance repeater mode and normal repeater mode.
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  39. Masleid, Robert Paul; Dholabhai, Vatsal, Repeater circuit with high performance repeater mode and normal repeater mode, wherein high performance repeater mode has fast reset capability.
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  40. Masleid,Robert Paul; Dholabhai,Vatsal, Repeater circuit with high performance repeater mode and normal repeater mode, wherein high performance repeater mode has fast reset capability.
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  41. Stoiber, Steven T.; Siu, Stuart, Ring based impedance control of an output driver.
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  42. Stoiber, Steven T.; Siu, Stuart, Ring based impedance control of an output driver.
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  43. Masleid, Robert Paul; Sousa, Jose; Kottapalli, Venkata, Scannable dynamic circuit latch.
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  44. Wada,Tooru; Sumita,Masaya, Semiconductor integrated circuit.
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  45. Masleid, Robert P.; Burr, James B., Stacked inverter delay chain.
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  46. Masleid,Robert P.; Burr,James B., Stacked inverter delay chain.
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  47. Lundberg, Jim, Teacher-pupil flip-flop.
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  48. Pitkethly, Scott; Masleid, Robert P., Triple latch flip flop system and method.
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  49. Pitkethly,Scott; Masleid,Robert P., Triple latch flip flop system and method.
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