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Methods and apparatus for initiating and resynchronizing multi-cycle SIMD instructions 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • G06F-009/38
출원번호 US-0598564 (2000-06-21)
발명자 / 주소
  • Pechanek, Gerald G.
  • Strube, David Carl
  • Wolff, Edward A.
  • Barry, Edwin Frank
  • Morris, Grayson
  • Busboom, Carl Donald
  • Schneider, Dale Edward
출원인 / 주소
  • PTS Corporation
대리인 / 주소
    Priest & Goldstein, PLLC
인용정보 피인용 횟수 : 21  인용 특허 : 5

초록

Techniques for adding more complex instructions and their attendant multi-cycle execution units with a single instruction multiple data, stream (SIMD) very long instruction word (VLIW) processing framework are described. In one aspect, an initiation mechanism also acts as a resynchronization mechani

대표청구항

Techniques for adding more complex instructions and their attendant multi-cycle execution units with a single instruction multiple data, stream (SIMD) very long instruction word (VLIW) processing framework are described. In one aspect, an initiation mechanism also acts as a resynchronization mechani

이 특허에 인용된 특허 (5)

  1. Elliott Timothy A. ; Henry G. Glenn ; Loper ; Jr. Albert J., Apparatus and method for improved floating point exchange.
  2. Tanaka Shigeya,JPX ; Hotta Takashi,JPX ; Yoshida Shoji,JPX ; Jin Kenji,JPX ; Saito Koji,JPX, Microprocessor.
  3. Moataz A. Mohamed, Reconfigurable functional units for implementing a hybrid VLIW-SIMD programming model.
  4. Johnson Anders R., Register file backup queue.
  5. Frank Steven ; Burkhardt ; III Henry ; Weber Frederick D. ; Lee Linda Q. ; Roskosz John A. ; Byers Brett D. ; Schnorr Peter C. ; Epstein David I., System for inserting instructions into processor instruction stream in order to perform interrupt processing.

이 특허를 인용한 특허 (21)

  1. Blandy, Geoffrey Owen, Apparatus and method for an enhanced integer divide in an IA64 architecture.
  2. Blandy, Geoffrey Owen; Johnson, Andrew, Apparatus and method for avoiding deadlocks in a multithreaded environment.
  3. Blandy, Geoffrey Owen, Apparatus and method for creating instruction bundles in an explicitly parallel architecture.
  4. Blandy, Geoffrey Owen; Johnson, Andrew; Shi, Danling, Apparatus and method for creating instruction groups for explicity parallel architectures.
  5. Ohtani, Sugako; Kondo, Hiroyuki, Data processing device.
  6. Ohtani, Sugako; Kondo, Hiroyuki, Data processing device.
  7. Ohtani, Sugako; Kondo, Hiroyuki, Data processing device.
  8. Ohtani, Sugako; Kondo, Hiroyuki, Data processing device.
  9. Ohtani, Sugako; Kondo, Hiroyuki, Data processing device.
  10. Ohtani,Sugako; Kondo,Hiroyuki, Data processing device.
  11. Pechanek, Gerald George; Stojancic, Mihailo M., Methods and apparatus for attaching application specific functions within an array processor.
  12. Pechanek, Gerald George; Barry, Edwin Franklin; Stojancic, Mihailo M., Methods and apparatus for independent processor node operations in a SIMD array processor.
  13. Pechanek, Gerald George; Barry, Edwin Franklin; Stojancic, Mihailo M., Methods and apparatus for independent processor node operations in a SIMD array processor.
  14. Pechanek,Gerald George; Strube,David; Wolff,Edward A.; Barry,Edwin Franklin; Morris,Grayson; Busboom,Carl Donald; Schneider,Dale Edward, Methods and apparatus for initiating and resynchronizing multi-cycle SIMD instructions.
  15. Pechanek,Gerald George; Strube,David; Wolff,Edward A.; Barry,Edwin Franklin; Morris,Grayson; Busboom,Carl Donald; Schneider,Dale Edward, Methods and apparatus for initiating and resynchronizing multi-cycle SIMD instructions.
  16. Stojancic, Mihailo M.; Pechanek, Gerald George, Methods and apparatus for motion search refinement in a SIMD array processor.
  17. Stojancic, Mihailo M.; Pechanek, Gerald George, Methods and apparatus for motion search refinement in a SIMD array processor.
  18. Stojancic, Mihailo M.; Pechanek, Gerald George, Methods and apparatus for motion search refinement in a SIMD array processor.
  19. Stojancic, Mihailo M.; Pechanek, Gerald George, Methods and apparatus for providing a scalable deblocking filtering assist function within an array processor.
  20. Stojancic, Mihailo M.; Pechanek, Gerald George, Methods and apparatus for providing a scalable motion estimation/compensation assist function within an array processor.
  21. Stojancic, Mihailo M.; Pechanek, Gerald George, Methods and apparatus for quarter-pel refinement in a SIMD array processor.
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