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Semiconductor device for suppressing detachment of conductive layer 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-023/48
  • H01L-023/52
출원번호 US-0791908 (2001-02-22)
우선권정보 KR-0059459 (2000-10-10)
발명자 / 주소
  • Kim, Sung-Bong
  • Kim, Joo-Young
  • Lim, Min-hwan
출원인 / 주소
  • Samsung Electronics Co., Ltd.
대리인 / 주소
    Mills & Onello LLP
인용정보 피인용 횟수 : 15  인용 특허 : 8

초록

A semiconductor device and a method for manufacturing the semiconductor device are provided in which a lower plug electrically connected with an active region of a wafer has a recession, and a conductive layer has a projection fitted into the recession of the lower plug, so that a contact area betwe

대표청구항

1. A semiconductor device comprising: a first interlevel dielectric (ILD) film having a substantially cylindrical opening having a first single diameter C; a diffusion barrier layer formed along the opening of the first ILD film; a substantially cylindrical lower plug having a second single dia

이 특허에 인용된 특허 (8)

  1. Yu Jick M. (Beaverton OR), Conductor fill reflow with intermetallic compound wetting layer for semiconductor fabrication.
  2. Omura Masayoshi,JPX, Damascene wiring with flat surface.
  3. David V. Horak ; William A. Klaasen ; Thomas L. McDevitt ; Mark P. Murray ; Anthony K. Stamper, Interconnection structure and method for fabricating same.
  4. Venkatesan Suresh ; Smith Bradley P. ; Islam Mohammed Rabiul, Method for forming a dual inlaid copper interconnect structure.
  5. Ho Yu Q. (Kanata CAX) Jolly Gurvinder (Orleans CAX) Emesh Ismail T. (Cumberland CAX), Method for forming interconnect structures for integrated circuits.
  6. Miller Robert O. (Carrollton TX), Method of making an integrated circuit structure by using a non-conductive plug.
  7. Liu Chung-Shi,TWX, Method of preparing CU interconnect lines.
  8. Uzoh Cyprian E., Triple damascence tungsten-copper interconnect structure.

이 특허를 인용한 특허 (15)

  1. Yang, Chih-Chao; Edelstein, Daniel C.; Molis, Steven E., Enhanced diffusion barrier for interconnect structures.
  2. Yang, Chih-Chao; Edelstein, Daniel C.; Molis, Steven E., Enhanced diffusion barrier for interconnect structures.
  3. Yang, Chih-Chao, Geometry control in advanced interconnect structures.
  4. Clevenger, Lawrence A.; Quon, Roger A.; Spooner, Terry A.; Wang, Wei; Yang, Chih-Chao, Interconnect structure.
  5. Yang, Chih-Chao, Interconnect structure and fabrication thereof.
  6. Simon, Andrew H.; Yang, Chih-Chao, Interconnect structure and method of forming.
  7. Chen, Chieh-Te; Chang, Feng-Yi; Huang, Chih-Sen; Hung, Ching-Wen; Hsu, Ching-Pin, Method for forming semiconductor structure having metal connection.
  8. Shin,Ju Cheol; Lee,Hyeon Deok; Park,Hong Mi; Park,In Sun, Methods of fabricating integrated circuit conductive contact structures including grooves.
  9. Briggs, Benjamin D.; Clevenger, Lawrence A.; Rizzolo, Michael; Yang, Chih-Chao, Neutral atom beam nitridation for copper interconnect.
  10. Briggs, Benjamin D.; Clevenger, Lawrence A.; Rizzolo, Michael; Yang, Chih-Chao, Neutral atom beam nitridation for copper interconnect.
  11. Yang, Chih-Chao, Self-formed liner for interconnect structures.
  12. Ono, Hitohisa, Semiconductor device and method of manufacturing the same.
  13. Kajita,Akihiro; Higashi,Kazuyuki, Semiconductor device having contact plug and buried conductive film therein.
  14. Clevenger, Lawrence A.; Quon, Roger A.; Spooner, Terry A.; Wang, Wei; Yang, Chih-Chao, Surface nitridation in metal interconnects.
  15. Clevenger, Lawrence A.; Quon, Roger A.; Spooner, Terry A.; Wang, Wei; Yang, Chih-Chao, Surface nitridation in metal interconnects.
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