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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0109966 (2005-04-19) |
발명자 / 주소 |
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출원인 / 주소 |
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대리인 / 주소 |
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인용정보 | 피인용 횟수 : 1 인용 특허 : 94 |
A field programmable gate array (FPGA) having hierarchical interconnect structure is disclosed. The FPGA includes logic heads that have signals routed therebetween by the interconnect structure. Each logic head includes a plurality of cascadable logic blocks that can perform combinatorial logic. The
1. A crossover switch adapted for use in an interconnect structure of a field programmable gate array (FPGA), said crossover switch for switching a propagating signal between any one of a first, a second, and a third vertical lines to any one of a first, a second, and a third intersecting horizontal
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