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Method and apparatus for transferring a thin layer of semiconductor material 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-021/30
출원번호 US-0638285 (2003-08-07)
발명자 / 주소
  • Walitzki, Hans J.
출원인 / 주소
  • Isonics Corporation
대리인 / 주소
    Sheridan Ross P.C.
인용정보 피인용 횟수 : 11  인용 특허 : 5

초록

The present invention provides a method and apparatus for lift-off of a thin layer from a crystalline substrate, preferably the layer from a silicon wafer to further form a silicon-on-insulator (SOI) sandwich structure, wherein a separation layer is formed inside a donor wafer by trapping hydrogen i

대표청구항

1. A method of forming a semiconductor wafer comprising:a. depositing a first charged ion made from a light element selected from the group consisting of H, D, He, Li, B, Ne, and Si under the surface of a first substrate wherein the first substrate is covered with a protective layer thinner than the

이 특허에 인용된 특허 (5)

  1. Aspar Bernard,FRX ; Bruel Michel,FRX ; Poumeyrol Thierry,FRX, Method of producing a thin layer of semiconductor material.
  2. Henley Francois J. ; Cheung Nathan W., Pressurized microbubble thin film separation process using a reusable substrate.
  3. Alexander Yuri Usenko, Process for manufacturing a silicon-on-insulator substrate and semiconductor devices on said substrate.
  4. Bruel Michel (Veurey FRX), Process for the production of thin semiconductor material films.
  5. Sakaguchi Kiyofumi,JPX ; Sato Nobuhiko,JPX, Substrate and production method thereof.

이 특허를 인용한 특허 (11)

  1. Samadi, Kambiz; Panth, Shreepad A.; Du, Yang, 3D floorplanning using 2D and 3D blocks.
  2. Samadi, Kambiz; Panth, Shreepad A.; Xie, Jing; Du, Yang, Clock distribution network for 3D integrated circuit.
  3. Xie, Jing; Du, Yang, Data transfer across power domains.
  4. Du, Yang; Xie, Jing; Samadi, Kambiz, Flip-flops in a monolithic three-dimensional (3D) integrated circuit (IC) (3DIC) and related methods.
  5. Shimomura, Akihisa; Koyama, Masaki; Higa, Eiji, Method for manufacturing SOI substrate.
  6. Bruel, Michel, Method for treating a part made from a decomposable semiconductor material.
  7. Du, Yang, Monolithic three dimensional integration of semiconductor integrated circuits.
  8. Ghyselen,Bruno; Rayssac,Olivier, Preventive treatment method for a multilayer semiconductor structure.
  9. Du, Yang, Three-dimensional (3-D) integrated circuits (3DICS) with graphene shield, and related components and methods.
  10. Xie, Jing; Du, Yang, Three-dimensional (3D) memory cell separation among 3D integrated circuit (IC) tiers, and related 3D integrated circuits (3DICS), 3DIC processor cores, and methods.
  11. Xie, Jing; Du, Yang, Three-dimensional (3D) memory cell separation among 3D integrated circuit (IC) tiers, and related 3D integrated circuits (3DICs), 3DIC processor cores, and methods.
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