$\require{mediawiki-texvc}$

연합인증

연합인증 가입 기관의 연구자들은 소속기관의 인증정보(ID와 암호)를 이용해 다른 대학, 연구기관, 서비스 공급자의 다양한 온라인 자원과 연구 데이터를 이용할 수 있습니다.

이는 여행자가 자국에서 발행 받은 여권으로 세계 각국을 자유롭게 여행할 수 있는 것과 같습니다.

연합인증으로 이용이 가능한 서비스는 NTIS, DataON, Edison, Kafe, Webinar 등이 있습니다.

한번의 인증절차만으로 연합인증 가입 서비스에 추가 로그인 없이 이용이 가능합니다.

다만, 연합인증을 위해서는 최초 1회만 인증 절차가 필요합니다. (회원이 아닐 경우 회원 가입이 필요합니다.)

연합인증 절차는 다음과 같습니다.

최초이용시에는
ScienceON에 로그인 → 연합인증 서비스 접속 → 로그인 (본인 확인 또는 회원가입) → 서비스 이용

그 이후에는
ScienceON 로그인 → 연합인증 서비스 접속 → 서비스 이용

연합인증을 활용하시면 KISTI가 제공하는 다양한 서비스를 편리하게 이용하실 수 있습니다.

Method of using foamed insulators in three dimensional multichip structures 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H01L-021/44
  • H01L-021/02
  • H01L-021/48
  • H01L-021/50
출원번호 US-0006043 (2004-12-07)
발명자 / 주소
  • Farrar,Paul A.
출원인 / 주소
  • Micron Technology, Inc.
대리인 / 주소
    Knobbe, Martens, Olson &
인용정보 피인용 횟수 : 0  인용 특허 : 16

초록

A multichip cube structure having a foamed insulating material disposed between adjacent integrated circuit chips. The foamed insulating material has lower dielectric constant and therefore reduces the capacitive coupling between electrical interconnects on adjacent chips. The foamed insulating mate

대표청구항

What is claimed is: 1. A method of manufacturing a multichip cube structure having reduced capacitive loading, comprising: forming an insulating layer on an upper bonding surface of a first chip; reducing the dielectric constant of the insulating layer by creating a plurality of voids in the insula

이 특허에 인용된 특허 (16)

  1. Go Tiong C. (El Toro CA), High-density electronic modules-process and product.
  2. Carson John C. (Corona del Mar CA) Clark Stewart A. (Irvine CA), High-density electronic processing package-structure and fabrication.
  3. Bertin Claude L. (So. Burlington VT) Farrar Paul A. (So. Burlington VT) Kelley ; Jr. Gordon A. (Essex Junction VT) Miller Christopher P. (Underhill VT), Method and apparatus for a stress relieved electronic module.
  4. Belanger Robert J. (Costa Mesa CA) Bisignano Alan G. (Anaheim CA), Method for fabricating modules comprising uniformly stacked, aligned circuit-carrying layers.
  5. Farrar Paul A., Method of forming a support structure for air bridge wiring of an integrated circuit.
  6. Farrar Paul A., Method of forming foamed polymeric material for an integrated circuit.
  7. Cha Sung W. (Cambridge MA) Suh Nam P. (Sudbury MA) Baldwin Daniel F. (Medford MA) Park Chul B. (Cambridge MA), Microcellular thermoplastic foamed with supercritical fluid.
  8. Asada Junichi,JPX, Package having very thin semiconductor chip, multichip module assembled by the package, and method for manufacturing the same.
  9. Bertin Claude L. (South Burlington VT) Farrar ; Sr. Paul A. (South Burlington VT) Howell Wayne J. (South Burlington VT) Miller Christopher P. (Underhill VT) Perlman David J. (Wappingers Falls NY), Polyimide-insulated cube package of stacked semiconductor device chips.
  10. Morinaga Shirou,JPX, Semiconductor device and method of forming semiconductor device.
  11. Ludwig David E. (Irvine CA) Saunders Christ H. (Laguna Niguel CA) Some Raphael R. (Williston VT) Stuart John J. (Newport Beach CA), Stack of IC chips in lieu of single IC chip.
  12. Grill Alfred ; Saenger Katherine Lynn, Structure and fabrication method for stackable, air-gap-containing low epsilon dielectric layers.
  13. Baldwin Daniel F. (Medford MA) Suh Nam P. (Sudbury MA) Park Chul B. (Cambridge MA) Cha Sung W. (Cambridge MA), Supermicrocellular foamed materials.
  14. Bertin Claude L. (South Burlington VT) Farrar ; Sr. Paul A. (South Burlington VT) Kalter Howard L. (Colchester VT) Kelley ; Jr. Gordon A. (Essex Junction VT) van der Hoeven Willem B. (Jericho VT) Whi, Three dimensional multichip package methods of fabrication.
  15. Toshiro Hiraoka JP; Koji Asakawa JP; Yasuyuki Hotta JP, Three dimensional structure and method of manufacturing the same.
  16. Bertin Claude L. (South Burlington) Farrar ; Sr. Paul A. (South Burlington) Kalter Howard L. (Colchester) Kelley ; Jr. Gordon A. (Essex Junction) van der Hoeven Willem B. (Jericho) White Francis R. (, Three-dimensional multichip packages and methods of fabrication.
섹션별 컨텐츠 바로가기

AI-Helper ※ AI-Helper는 오픈소스 모델을 사용합니다.

AI-Helper 아이콘
AI-Helper
안녕하세요, AI-Helper입니다. 좌측 "선택된 텍스트"에서 텍스트를 선택하여 요약, 번역, 용어설명을 실행하세요.
※ AI-Helper는 부적절한 답변을 할 수 있습니다.

선택된 텍스트

맨위로