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Interprocedural dead store elimination 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • G06F-009/45
  • G06F-009/44
출원번호 US-0965521 (2001-09-27)
우선권정보 CA-2321016(2000-09-27)
발명자 / 주소
  • Archambault,Roch Georges
출원인 / 주소
  • International Business Machines Corporation
대리인 / 주소
    McGinn IP Law Group, PLLC
인용정보 피인용 횟수 : 8  인용 특허 : 15

초록

A system for optimizing computer code generation by carrying out interprocedural dead store elimination. The system carries out a top down traversal of a call graph in an intermediate representation of the code being compiled. Live on exit (LOE) sets are defined for variables at call points for func

대표청구항

The embodiments of the invention in which an exclusive property or privilege is claimed are defined as follows: 1. A method for determining the correctness of a potential interprocedural dead store optimization for an optimizing compiler, the optimizing compiler generating an intermediate represent

이 특허에 인용된 특허 (15)

  1. Van Dyke Don A. (Pleasanton CA) Cramer Timothy J. (Pleasanton CA) Rasbold James C. (Livermore CA) O\Hair Kelly T. (Livermore CA) Cox David M. (Livermore CA) Seberger David A. (Livermore CA) O\Gara Li, Computer with integrated hierarchical representation (IHR) of program wherein IHR file is available for debugging and op.
  2. Baker Henry G. (16231 Meadow Ridge Way Encino CA 91436), Garbage collection, tail recursion and first-class continuations in stack-oriented languages.
  3. Blainey Robert James,CAX ; Donawa Christopher Michael,CAX ; McInnes James Lawrence,CAX, Global variable coalescing.
  4. Odnert Daryl (Boulder Creek CA) Santhanam Vatsa (Sunnyvale CA), Method and apparatus for compiling computer programs with interprocedural register allocation.
  5. Odnert Daryl (Boulder Creek CA) Santhanam Vatsa (Sunnyvale CA), Method and apparatus for compiling computer programs with interproceduural register allocation.
  6. Sreedhar Vugranam C. ; Ju Dz-ching ; Gillies David Mitford ; Santhanam Vatsa, Method and system for eliminating phi instruction resource interferences and redundant copy instructions from static-single-assignment-form computer code.
  7. Jong-Deok Choi ; Manish Gupta ; Mauricio J. Serrano ; Vugranam C. Sreedhar ; Samuel Pratt Midkiff, Method for optimizing creation and destruction of objects in computer programs.
  8. Bradley Alan C. (Portland OR) Vegdahl Steven R. (Beaverton OR) Adams Norman I. (Portland OR), Method for reducing memory allocations and data copying operations during program calling sequences.
  9. Holler Anne M. ; Benitez Manuel E., Method for restructuring code to reduce procedure call overhead.
  10. Jong-Deok Choi ; Manish Gupta ; Michael Hind, Methods and apparatus for optimizing programs in the presence of exceptions.
  11. Bacon David Francis ; Wegman Mark N. ; Zadeck Frank Kenneth, Object oriented dispatch optimization.
  12. Archambault Roch G.,CAX, Optimizing compilation of pointer variables in the presence of indirect function calls.
  13. Hiranandani Seema ; Ho Wingsturn Wilson, System and method for constaint propagation cloning for unknown edges in IPA.
  14. Spix George A. (Eau Claire WI) Wengelski Diane M. (Eau Claire WI) Hawkinson Stuart W. (Eau Claire WI) Johnson Mark D. (Eau Claire WI) Burke Jeremiah D. (Eau Claire WI) Thompson Keith J. (Eau Claire W, System and method for controlling a highly parallel multiprocessor using an anarchy based scheduler for parallel executi.
  15. Burke Michael G. (Yonkers NY) Carini Paul R. (Sherman CT) Choi Jong-Deok (Mount Kisco NY), Using program call graphs to determine the maximum fixed point solution of interprocedural bidirectional data flow probl.

이 특허를 인용한 특허 (8)

  1. Yourst,Matt T; Ghose,Kanad, Method and apparatus for incremental commitment to architectural state in a microprocessor.
  2. Sawyer, David G.; Ashe, Dylan; Rosenquist, Brent E., Methods and apparatus to improve application launch time.
  3. Poznanovic, Daniel; Hammes, Jeffrey; Krause, Lisa; Steidel, Jon; Barker, David; Brooks, Jeffrey Paul, Process for converting programs in high-level programming languages to a unified executable for hybrid computing platforms.
  4. George, Biju; Lueh, Guei-Yuan, Register liveness analysis for SIMD architectures.
  5. George, Biju; Lueh, Guei-Yuan, Register liveness analysis for SIMD architectures.
  6. Avadhanula, Srinath; Raghavan, Vijay, Restructuring control flow graphs generated from a model.
  7. Nesbitt, Richard Elderkin; O'Connell, Brian Marshall; Vaughan, Kevin Edward, System, method and program product to optimize code during run time.
  8. Bearman, Ian M.; Radigan, James J., Tool for processing software programs using modified live-ness definition.
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