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Structures and methods for testing programmable logic devices having mixed-fabric architectures 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • H03K-019/173
출원번호 US-0136114 (2005-05-24)
발명자 / 주소
  • Lai,Andrew W.
출원인 / 주소
  • Xilinx, Inc.
인용정보 피인용 횟수 : 5  인용 특허 : 16

초록

초록이 없습니다.

대표청구항

대표청구항이 없습니다.

이 특허에 인용된 특허 (16)

  1. Herron,Nigel G.; Thorne,Eric J.; Wang,Qingqi, Apparatus for testing an interconnecting logic fabric.
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  2. Wells, Robert W.; Ling, Zhi-Min; Patrie, Robert D.; Tong, Vincent L.; Cho, Jae; Toutounchi, Shahin, Application-specific testing methods for programmable logic devices.
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  3. Hartmann Alfred C., Dynamically reconfigurable logic networks interconnected by fall-through FIFOs for flexible pipeline processing in a system-on-a-chip.
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  4. Clifford Hessel ; Paul E. Voglewede ; Michael E. Kreeger ; Christopher D. Mackey ; Scott E. Marks ; Alfred W. Pietzold, III ; Louis M. Orsini ; John E. Gorton, Field programmable radio frequency communications equipment including a configurable if circuit, and method therefor.
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  5. Andrews William B. ; Britton Barry K. ; Hickey Thomas J. ; Modo Ronald T. ; Nguyen Ho T. ; Schadt Lorraine L. ; Singh Satwant, Hybrid programmable gate arrays.
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  6. Gilson Kent L. (255 N. Main St. ; Apt. 210 Salt Lake City UT 84115), Integrated circuit computing device comprising a dynamically configurable gate array having a microprocessor and reconfi.
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  7. Cooke Laurence H. ; Phillips Christopher E. ; Wong Dale, Integrated processor and programmable data path chip for reconfigurable computing.
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  8. Wong Dale ; Phillips Christopher E. ; Cooke Laurence H., Integrated processor and programmable data path chip for reconfigurable computing.
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  9. Trimberger Stephen M., Method for compiling and executing programs for reprogrammable instruction set accelerator.
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  10. Jose Maria Insenser Farre ES; Julio Faura Enriquez ES, Microprocessor based mixed signal field programmable integrated device and prototyping methodology.
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  11. Muthujumaraswathy Kumaraguru ; Rostoker Michael D., Multimedia interface having a multimedia processor and a field programmable gate array.
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  12. Trimberger Stephen M. (San Jose CA), Non-reconfigurable microprocessor-emulated FPGA.
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  13. Jacobson Neil G. ; Curd Derek R., On-chip programming verification system for PLDs.
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  14. Kimura Junichi (Hachiouji JPX) Nejime Yoshito (Hachiouji JPX) Noguchi Kouji (Kokubunji JPX), Programmable digital signal processor for performing a plurality of signal processings.
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  15. Arnold, Jeffrey M.; Camarota, Rafael C.; Hassoun, Joseph H.; Rupp, Charle' R., Programmable logic core adapter.
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  16. Collins Mark Andrew (Austin TX), Reconfigurable network interface apparatus and method.
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이 특허를 인용한 특허 (5)

  1. Ding, Ming H.; Wijesuriya, Sajitha; Zhao, Jun; Agrawal, Om P.; Britton, Barry; He, Xiaojie, Area efficient routing architectures for programmable logic devices.
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  2. Yao, Stephen U.; Samson, Darwin D. Q.; Yap, Ket-Chong, FPGA programming structure for ATPG test coverage.
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  3. Hutton, Michael D.; Schleicher, II, James G.; Mansur, Daniel R., Field programmable gate array with integrated application specific integrated circuit fabric.
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  4. Hutton, Michael D.; Schleicher, II, James G.; Mansur, Daniel R., Field programmable gate array with integrated application specific integrated circuit fabric.
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  5. Hutton, Michael D.; Schleicher, II, James G.; Mansur, Daniel R., Field programmable gate array with integrated application specific integrated circuit fabric.
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