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Multiprocessor computer architecture incorporating a plurality of memory algorithm processors in the memory subsystem 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • G06F-009/54
  • G06F-009/46
출원번호 US-0969635 (2004-10-20)
발명자 / 주소
  • Huppenthal,Jon M.
  • Leskar,Paul A.
출원인 / 주소
  • SRC Computers, Inc.
대리인 / 주소
    Hogan & Hartson LLP
인용정보 피인용 횟수 : 7  인용 특허 : 16

초록

초록이 없습니다.

대표청구항

대표청구항이 없습니다.

이 특허에 인용된 특허 (16)

  1. Casselman Steven M., Computer network of distributed virtual computers which are EAC reconfigurable in response to instruction to be executed.
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  2. Casselman Steven M., Computer with programmable arrays which are reconfigurable in response to instructions to be executed.
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  3. DeHon Andre ; Bolotski Michael ; Knight ; Jr. Thomas F., DPGA-coupled microprocessors.
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  4. Cloutier Jocelyn, FPGA-based processor.
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  5. Helbig ; Sr. Walter A, Method and apparatus for enhancing computer system security.
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  6. Burke, David, Method and apparatus for executing standard functions in a computer system using a field programmable gate array.
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  7. Fandrich Mickey L. (Placerville CA) Durante Richard J. (Citrus Heights CA) Underwood Keith F. (Orangevale CA) Rozman Rodney R. (Placerville CA), Method and apparatus for execution of operations in a flash memory array.
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  8. Fong Anthony S. (Southboro MA), Method and apparatus for floating point operations.
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  9. Cooke Laurence H. ; Phillips Christopher E. ; Wong Dale, Method for compiling high level programming languages into an integrated processor with reconfigurable logic.
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  10. Huppenthal Jon M. ; Leskar Paul A., Multiprocessor computer architecture incorporating a plurality of memory algorithm processors in the memory subsystem.
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  11. Grunewald Paul ; Stelter Wesley H. ; Ding Jiangang, PCI-compliant interrupt steering architecture.
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  12. Tan Charles M. C., Programmable gate array configuration memory which allows sharing with user memory.
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  13. Lytle Craig S. (Mountain View CA) Faria Donald F. (San Jose CA), Programmable logic array integrated circuit incorporating a first-in first-out memory.
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  14. Shido Tatsuya (Kawasaki JPX) Kawamura Kaoru (Yokohama JPX) Umeda Masanobu (Yokohama JPX) Shibuya Toshiyuki (Inagi JPX) Miwatari Hideki (Yokohama JPX), SIMD system having logic units arranged in stages of tree structure and operation of stages controlled through respectiv.
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  15. Sgro Joseph A. ; Stanton Paul C., Scalable multi-processor architecture for SIMD and MIMD operations.
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  16. De Oliveira Kastrup Pereira, Bernardo; Bink, Adrianus J.; Hoogerbrugge, Jan, System for executing computer program using a configurable functional unit, included in a processor, for executing configurable instructions having an effect that are redefined at run-time.
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이 특허를 인용한 특허 (7)

  1. Metlapalli, Kumar C., Methods and systems for computing platform.
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  2. Yancey, Jerry W., Reconfigurable neural network systems and methods utilizing FPGAs having packet routers.
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  3. McGarry, Patrick F.; Sorber, David B.; Bresnan, Timothy P.; Huo, Andrew; Harris, Robert M.; Agrawal, Varun K., Storage management systems and methods.
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  4. Tewalt, Timothy J., System and method for retaining DRAM data when reprogramming reconfigurable devices with DRAM memory controllers.
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  5. Tewalt, Timothy J., System and method for retaining dram data when reprogramming reconfigurable devices with DRAM memory controllers incorporating a data maintenance block colocated with a memory module or subsystem.
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  6. McGarry, Patrick F.; Sorber, David B.; Bresnan, Timothy P.; Huo, Andrew, Systems and methods for managing execution of specialized processors.
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  7. McGarry, Patrick F.; Sorber, David B.; Bresnan, Timothy P.; Huo, Andrew; Agrawal, Varun K.; Stupar, Brian R.; Griffin, Christopher M.; Barthelemy, Jeremy L.; Harris, Robert M.; Gantz, Paul C., Systems and methods for performing primitive tasks using specialized processors.
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