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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0479552 (2009-06-05) |
등록번호 | US7999600 (2011-08-03) |
발명자 / 주소 |
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출원인 / 주소 |
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대리인 / 주소 |
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인용정보 | 피인용 횟수 : 2 인용 특허 : 9 |
A circuit for limiting di/dt caused by a main switching FET during its turn-off against an inductive switching circuit is proposed. The circuit for limiting di/dt includes an auxiliary inductor in series with the main switching FET for inducing an auxiliary inductive voltage proportional to di/dt; a
What is claimed are: 1. A circuit for limiting di/dt caused by a main switching FET during its unclamped or partially unclamped inductive turn-off, the circuit comprises an intervening auxiliary inductor having a first terminal in series connection with the main switching FET through its source; and
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