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Solder preform 원문보기

IPC분류정보
국가/구분 United States(US) Patent 등록
국제특허분류(IPC7판)
  • B23K-035/14
출원번호 US-0699740 (2010-02-03)
등록번호 US8061578 (2011-11-07)
발명자 / 주소
  • Hartnett, Amanda M.
  • Socha, Paul
출원인 / 주소
  • Indium Corporation
대리인 / 주소
    Sheppard Mullin Richter & Hampton LLP
인용정보 피인용 횟수 : 5  인용 특허 : 12

초록

A solder preform has gaps extending from the boundary of preform towards the preform center. During reflow soldering, the gaps close from the center towards the boundary. This allows flux and gasses to escape the interface between the solder and the substrate. Particularly, flux accumulates in the s

대표청구항

The invention claimed is: 1. A solder preform, comprising:a solder material occupying a portion of an area defined by a first boundary and a second boundary and having a plurality of gaps;wherein the solder preform has a perimeter defined by the first boundary and the plurality of gaps;wherein a fir

이 특허에 인용된 특허 (12)

  1. Rogren Philip E. (624 Silver Ave. Half Moon Bay CA 94019-1565), Device and method for forming and attaching an array of conductive balls.
  2. Matt Lukas (Eschen DEX), Device for assembling a cam member with a cam shaft.
  3. Socha Paul A. (Whitesboro NY), Integrated preforms.
  4. Socha Paul A., Integrated solder preform array having a tin outer coating.
  5. Antao Joseph S., Method of forming ball grid array contacts.
  6. Modl Albert,DEX ; Schutt Joachim,DEX, Method of forming discrete solder portions on respective contact pads of a printed circuit board.
  7. Koskenmaki David C. (St. Paul MN) Calhoun Clyde D. (Grant Township ; Washington County MN), Patterned array of uniform metal microbeads.
  8. Harada, Tomoko, Solder ball and interconnection structure using the same.
  9. Seungbae Park ; Sanjeev Sathe ; Aleksander Zubelewicz, Solder interconnect techniques.
  10. Trott Gary R ; Chew Geary L. ; Schwiebert Matthew K., Solder paste containment device.
  11. Dozier ; II Thomas H. ; Khandros Igor Y., Solder preforms.
  12. Too, Seah Sun; Liau, Hsiang Wan; Kirkland, Janet; Tan, Tek Seng; Touzelbaev, Maxat; Master, Raj N., Void reduction in indium thermal interface material.

이 특허를 인용한 특허 (5)

  1. Colgan, Evan G.; Nah, Jae-Woong, Chip stack with electrically insulating walls.
  2. Colgan, Evan G.; Nah, Jae-Woong, Chip stack with electrically insulating walls.
  3. Colgan, Evan G.; Nah, Jae-Woong, Chip stack with electrically insulating walls.
  4. Ross, Jordan Peter; Hartnett, Amanda M., Low void solder joint for multiple reflow applications.
  5. Arunasalam, Parthiban; Bhopte, Siddharth; Ojeda, Sr., Joe Albert, Method for making a solder joint.
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