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NTIS 바로가기국가/구분 | United States(US) Patent 등록 |
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국제특허분류(IPC7판) |
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출원번호 | US-0238123 (2005-09-28) |
등록번호 | US-8112466 (2012-02-07) |
우선권정보 | IN-1862/DEL/2004 (2004-09-28) |
발명자 / 주소 |
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출원인 / 주소 |
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인용정보 | 피인용 횟수 : 14 인용 특허 : 3 |
An efficient implementation of DSP functions in a field programmable gate array (FPGA) using one or more computational blocks, each block having of a multiplier, an accumulator, and multiplexers. The structure implements most common DSP equations in a fast and a highly compact manner. A novel method
1. A Field Programmable Gate Array (FPGA) comprising: a first computational block comprising: a multiplier configured to receive a first data input and a second data input;a first multiplexer comprising a dynamic select line and configured to receive a third data input;an accumulator configured to r
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